[发明专利]一种DRAM存储芯片三维集成封装方法及结构在审
申请号: | 201911037537.4 | 申请日: | 2019-10-29 |
公开(公告)号: | CN110690178A | 公开(公告)日: | 2020-01-14 |
发明(设计)人: | 王成迁 | 申请(专利权)人: | 中国电子科技集团公司第五十八研究所 |
主分类号: | H01L21/8242 | 分类号: | H01L21/8242;H01L27/108 |
代理公司: | 32340 无锡派尔特知识产权代理事务所(普通合伙) | 代理人: | 杨立秋 |
地址: | 214000 *** | 国省代码: | 江苏;32 |
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摘要: | 本发明公开一种DRAM存储芯片三维集成封装方法及结构,属于集成电路封装技术领域。提供母片和子片,将所述母片和所述子片堆叠键合。通过如下方法形成母片:提供玻璃基板,在所述玻璃基板上旋涂键合层;在所述键合层上摆放TSV转接芯片和存储芯片;通过塑封料塑封,并减薄至目标厚度;在所述存储芯片上制作粘结层。通过如下方法形成子片:另外提供TSV转接芯片和存储芯片,并将其塑封;形成连接子片中转接芯片和存储芯片的n层重布线;制作凸点。最后用底填料填充凸点缝隙,通过塑封料塑封并减薄至目标厚度;在所述子片背面制作粘结层,再键合一个子片;重复上述步骤,完成多层三维堆叠;最后一层由存储芯片塑封而成,并形成有n层布线和凸点。 | ||
搜索关键词: | 存储芯片 塑封 子片 转接芯片 母片 凸点 玻璃基板 键合层 塑封料 粘结层 减薄 制作 集成电路封装 三维堆叠 三维集成 底填料 连接子 重布线 布线 堆叠 多层 键合 上旋 填充 封装 背面 摆放 重复 | ||
【主权项】:
1.一种DRAM存储芯片三维集成封装方法,其特征在于,包括:提供母片和子片,将所述母片和所述子片堆叠键合;其中,/n通过如下方法形成母片:/n提供玻璃基板,在所述玻璃基板上旋涂键合层;/n在所述键合层上摆放TSV转接芯片和存储芯片;/n通过塑封料塑封,并减薄至目标厚度;/n在所述存储芯片上制作粘结层;/n通过如下方法形成子片:/n另外提供TSV转接芯片和存储芯片,并将其塑封;/n形成连接子片中转接芯片和存储芯片的n层重布线;/n制作凸点;/n将所述母片和所述子片堆叠键合包括:/n所述母片和所述子片通过C2W方式键合;/n用底填料填充凸点缝隙,通过塑封料塑封并减薄至目标厚度;/n在所述子片背面制作粘结层,再键合一个子片;重复上述步骤,完成多层三维堆叠;/n最后一层由存储芯片塑封而成,并形成有n层布线和凸点。/n
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造