[发明专利]数字占空比校正电路系统在审
| 申请号： | 201910861413.1 | 申请日： | 2019-09-12 |
| 公开（公告）号： | CN110492872A | 公开（公告）日： | 2019-11-22 |
| 发明（设计）人： | 李路;陈波;方敏;周春元;罗俊 | 申请（专利权）人： | 珠海微度芯创科技有限责任公司 |
| 主分类号： | H03K5/156 | 分类号： | H03K5/156;H03K5/133;H03K7/08 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 519000 广东省珠海市高*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明公开了一种数字占空比校正电路系统，包括：窄脉冲产生电路、半时钟周期延迟电路、触发复位锁存器；窄脉冲产生电路接收输入时钟信号，窄脉冲产生电路的输出端口分别连接至半时钟周期延迟电路的输入端口及触发复位锁存器的S端口；半时钟周期延迟电路的输出端口连接至所述触发复位锁存器的R端口；所述触发复位锁存器的输出端口得到输出时钟信号。本发明的技术方案通过增加半时钟周期延迟链中的数据锁存器、选通器和或门电路，以微小的面积和功耗代价消除了电路输出毛刺的风险，增加了电路系统的鲁棒性。 | ||
| 搜索关键词： | 半时钟周期 复位锁存器 触发 窄脉冲产生电路 延迟电路 输出端口 占空比校正电路 毛刺 输出端口连接 输出时钟信号 数据锁存器 电路输出 电路系统 或门电路 接收输入 时钟信号 输入端口 鲁棒性 面积和 选通器 延迟链 功耗 | ||
【主权项】：
1.一种数字占空比校正电路系统，其特征在于，包括窄脉冲产生电路、半时钟周期延迟电路、触发复位锁存器；/n所述窄脉冲产生电路的输入端口接收输入时钟信号，所述窄脉冲产生电路的输出端口分别连接至所述半时钟周期延迟电路的输入端口及所述触发复位锁存器的S端口；所述半时钟周期延迟电路的输出端口连接至所述触发复位锁存器的R端口；所述触发复位锁存器的输出端口得到输出时钟信号；/n所述半时钟周期延迟电路包括前向延迟链、反向延迟链、逻辑门阵列；所述前向延迟链连接至所述逻辑门阵列，所述逻辑门阵列连接至所述反向延迟链；/n所述前向延迟链包括级联的n个前向延迟单元，其中n为大于等于2的偶数；所述反向延迟链包括级联的n/2个反向延迟单元；所述逻辑门阵列包括并行的n/2个逻辑门电路模块，每个逻辑门电路模块对应连接至2个前向延迟单元及1个反向延迟单元。/n
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