[发明专利]一种哈希硬件处理装置及方法有效
申请号: | 201910413959.0 | 申请日: | 2019-05-17 |
公开(公告)号: | CN110211617B | 公开(公告)日: | 2020-12-29 |
发明(设计)人: | 李文明;叶笑春;安述倩;姜志颖;王晨晖;范东睿 | 申请(专利权)人: | 中国科学院计算技术研究所 |
主分类号: | G11C13/00 | 分类号: | G11C13/00;G06F16/901 |
代理公司: | 北京泛华伟业知识产权代理有限公司 11280 | 代理人: | 王勇 |
地址: | 100190 北*** | 国省代码: | 北京;11 |
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摘要: | 本发明提供一种基于阻变存储器的哈希硬件处理装置及方法,所有的源数据无需送往CPU进行哈希函数的计算,在RRAM中根据电流叠加效应即可完成哈希函数输入数据的操作,并在存储器中实现哈希表的建立,无需将大量的源数据送往CPU后再送回存储器中。本发明基于阻变存储器的数据处理将减少数据从存储器端向处理器端的数据搬运,尤其于对数据量大的应用来说,具有显著的性能优势和功耗优势。通过在RRAM存储器中利用RRAM存储单元可实现基于电流叠加原理实现的存储数据的累加功能,进行哈希表的建立,避免数据读取到CPU端进行计算后再写入哈希表,一方面减少大量数据从存储端向CPU端的搬运,减少对访存带宽的需求;另一方面可以提高哈希表建立和查询的执行效率,并降低处理功耗。 | ||
搜索关键词: | 一种 硬件 处理 装置 方法 | ||
【主权项】:
1.一种哈希硬件处理装置,其特征在于,包括如下模块:阻变存储器,其包括用于存储待哈希处理的源数据的多个存储单元,以及用于读出或者写入数据位的字线和位线;字线控制逻辑,用于控制阻变存储器中字线的选通;位线控制逻辑,用于控制阻变存储器中位线的选通;哈希值处理单元,其连接到所述阻变存储器并用于从阻变存储器中接收所选通的字线上的源数据的一个或者多个数据位的输出,生成由所述字线选通的源数据的哈希值;哈希表管理和存储单元,用于接收并存储所述哈希值和对应的源数据。
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