[发明专利]一种高速数据实时交换处理装置有效

专利信息
申请号: 201811076252.7 申请日: 2018-09-14
公开(公告)号: CN108829618B 公开(公告)日: 2023-09-29
发明(设计)人: 周磊;王亚会;尹中锋;李玉松;黄彦海;李红玉 申请(专利权)人: 河南中光学集团有限公司
主分类号: G06F13/16 分类号: G06F13/16
代理公司: 郑州红元帅专利代理事务所(普通合伙) 41117 代理人: 秦舜生
地址: 473000 *** 国省代码: 河南;41
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摘要: 发明公开了一种高速数据实时交换处理装置,包括数据采集解析模块、输入缓存模块、信号冲突处理模块、中间缓存模块及输出缓存模块,所述数据采集解析模块分别与输入缓存模块和信号冲突处理模块连接,所述输入缓存模块分别与第一控制开关、中间缓存模块、第二控制开关及输出缓存模块连接,所述输出缓存模块与处理器总线连接,所述信号冲突处理模块分别与第一控制开关、第二控制开关连接。与现有技术相比,本发明在在高速数据采集应用中的实时控制场合,实时算法能够快速、准确、不遗漏的获取高速采集到的数据,此种数据交互方法简单、高效、灵活,能够实现灵活快速实时的数据传输,而且不影响系统性能。
搜索关键词: 一种 高速 数据 实时 交换 处理 装置
【主权项】:
1.一种高速数据实时交换处理装置,其特征在于:包括数据采集解析模块、输入缓存模块、信号冲突处理模块、中间缓存模块及输出缓存模块,所述数据采集解析模块分别与输入缓存模块和信号冲突处理模块连接,所述输入缓存模块分别与第一控制开关、中间缓存模块、第二控制开关及输出缓存模块连接,所述输出缓存模块与处理器总线连接,且所述输出缓存模块传递Data信号至处理器总线,所述信号冲突处理模块分别与第一控制开关、第二控制开关连接,所述信号冲突处理模块与所述处理器总线之间实现读取信号RD和Busy的互通;工作时,所述数据采集解析模块采集并解析原始高速位流数据,解析后的高速数据传输至输入缓存模块,输出的Ready标志经过信号冲突处理模块的处理后,产生信号导通第一控制开关,将高速数据传输至中间缓存模块,上位机通过处理器总线读取中间缓存模块的数据,在信号冲突处理模块的处理后,产生信号导通第二控制开关,导通后中间缓存模块中的数据传输给输出缓存模块,输出缓存模块在总线读取控制下安装字长度分时读出。
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