[发明专利]MRAM器件与其制作方法有效
| 申请号: | 201810682586.2 | 申请日: | 2018-06-27 |
| 公开(公告)号: | CN110648960B | 公开(公告)日: | 2021-12-28 |
| 发明(设计)人: | 郑富强;左正笏 | 申请(专利权)人: | 中电海康集团有限公司;浙江驰拓科技有限公司 |
| 主分类号: | H01L21/768 | 分类号: | H01L21/768;H01L23/538;H01L27/22 |
| 代理公司: | 北京康信知识产权代理有限责任公司 11240 | 代理人: | 韩建伟;霍文娟 |
| 地址: | 311121 浙江省杭州*** | 国省代码: | 浙江;33 |
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| 摘要: | 本申请提供了一种MRAM器件与其制作方法。该制作方法包括:步骤S1,在互连介质层中设置第一互连部和第二互连部;步骤S2,在互连介质层的表面上依次设置第一刻蚀阻挡层和第一介质层;步骤S3,在第一互连部上方的第一刻蚀阻挡层和第一介质层内形成第一金属孔;步骤S4,在第一互连部上方的第一介质层的表面上依次设置底电极、MTJ单元、顶电极与第二刻蚀阻挡层;步骤S5,在第二介质层的远离第一介质层的表面上依次设置第三介质层、第三刻蚀阻挡层和第四介质层;步骤S6,开设第二通孔与第三通孔;步骤S7,在第二通孔和第三通孔中填充金属。该制作方法减小了工艺难度,提高了器件的成本率。 | ||
| 搜索关键词: | mram 器件 与其 制作方法 | ||
【主权项】:
1.一种MRAM器件的制作方法,其特征在于,所述制作方法包括:/n步骤S1,在衬底表面上的互连介质层(10)中设置第一互连部(11)和第二互连部(12),所述第一互连部(11)和所述第二互连部(12)交替且间隔设置;/n步骤S2,在所述互连介质层(10)的远离所述衬底的表面上依次设置第一刻蚀阻挡层(20)和第一介质层(30);/n步骤S3,在所述第一互连部(11)上方的所述第一刻蚀阻挡层(20)和所述第一介质层(30)内形成第一金属孔(40),所述第一金属孔(40)与所述第一互连部(11)电连接;/n步骤S4,在所述第一互连部(11)上方的所述第一介质层(30)的远离所述第一刻蚀阻挡层(20)的表面上依次设置底电极(60)、MTJ单元(70)、顶电极(80)与第二刻蚀阻挡层(90),所述底电极(60)与所述第一金属孔(40)电连接,且所述底电极(60)、所述MTJ单元(70)以及所述顶电极(80)位于第二介质层(50)中,且所述第二介质层(50)位于所述第二互连部(12)上方的所述第一介质层(30)的远离所述第一刻蚀阻挡层(20)的表面上;/n步骤S5,在所述第二介质层(50)的裸露表面上以及所述第二刻蚀阻挡层(90)的裸露表面上依次设置第三介质层(100)、第三刻蚀阻挡层(110)和第四介质层(120);/n步骤S6,在所述第一互连部(11)上方的所述第四介质层(120)、所述第三刻蚀阻挡层(110)、所述第三介质层(100)和所述第二刻蚀阻挡层(90)中开设第二通孔(130),在所述第二互连部(12)上方的所述第四介质层(120)、所述第三刻蚀阻挡层(110)、所述第三介质层(100)、所述第二介质层(50)和所述第二刻蚀阻挡层(90)中开设第三通孔(140);以及/n步骤S7,在所述第二通孔(130)和所述第三通孔(140)中填充金属,形成第二金属孔(131)和第三金属孔(141)。/n
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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