[发明专利]Crypt-SHA512加密算法的加速装置与方法有效
| 申请号： | 201810562960.5 | 申请日： | 2018-06-04 |
| 公开（公告）号： | CN108959128B | 公开（公告）日： | 2023-03-31 |
| 发明（设计）人： | 陈敏珍;刘鹏 | 申请（专利权）人： | 浙江大学 |
| 主分类号： | G06F12/14 | 分类号： | G06F12/14 |
| 代理公司： | 杭州中成专利事务所有限公司 33212 | 代理人： | 金祺 |
| 地址： | 310058 浙江*** | 国省代码： | 浙江;33 |
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| 摘要： | 本发明提供了一种Crypt‑SHA512加密算法的加速装置，包括由FPGA和CPU。FPGA包括存储单元、状态控制器、数据选择器以及流水计算单元；数据选择器的数量与消息分组的字节数相同；消息分组填充的数据的每个字节通过对应数据选择器由存储单元输送至流水计算单元。本发明还提供一种利用上述装置进行加速的方法；根据口令长度和固定的盐值长度对FPGA进行重构，令粗粒度数据通路与口令长度和盐值长度相对应，从而仅由迭代次数确定消息填充的方式；再利用数据选择器控制细粒度数据通路调整，实现每个时钟周期都有一个消息分组输入到流水计算单元中，使得数据流不间断地通过流水计算单元，不出现阻塞，加快计算速度。 | ||
| 搜索关键词： | crypt sha512 加密算法 加速 装置 方法 | ||
【主权项】：
1.Crypt‑SHA512加密算法的加速装置，包括FPGA与通用CPU组成的CPU‑FPGA异构系统，CPU和FPGA通过总线接口相互连接，其特征在于：所述CPU用于进行Crypt‑SHA512加密算法初始化阶段和输出阶段的计算；所述FPGA用于进行Crypt‑SHA512加密算法循环阶段的加速计算；所述CPU将Crypt‑SHA512加密算法初始化阶段的计算结果发送至FPGA，由FPGA进行循环阶段加速计算后，FPGA再将计算结果发送至CPU进行输出阶段的计算。
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