[发明专利]数字时间转换器辅助的全数字锁相环电路有效
| 申请号： | 201780096907.4 | 申请日： | 2017-12-19 |
| 公开（公告）号： | CN111386657B | 公开（公告）日： | 2023-09-22 |
| 发明（设计）人： | 杨腾智;陈雪松;于锐;刘苏鹏;袁超 | 申请（专利权）人： | 华为国际有限公司 |
| 主分类号： | H03L7/085 | 分类号： | H03L7/085;H03L7/093;H03L7/08 |
| 代理公司： | 北京龙双利达知识产权代理有限公司 11329 | 代理人： | 周乔;王君 |
| 地址： | 新加坡新加坡市签名大厦*** | 国省代码： | 暂无信息 |
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| 摘要： | 本发明公开了一种数字时间转换器(digital‑to‑time converter，DTC)辅助的全数字锁相环(all digital phase locked loop，ADPLL)电路(200)，包括：DTC误差补偿器(202)，用于接收相位偏移信号，所述相位偏移信号是对时间数字转换器(time‑to‑digital converter，TDC)电路(204)的输出进行处理之后得到的，所述相位偏移信号包括DTC误差，所述DTC误差对应于经过DTC电路(206)处理的参考时钟信号与取自所述ADPLL电路的输出信号的反馈时钟信号之间的相位差。所述补偿器用于处理所述相位偏移信号，以生成表示所述DTC误差的数字信号，所述数字信号作为输出信号。另外，将所述输出信号从所述相位偏移信号中减去，得到所述相位偏移信号的相位纠正信号。 | ||
| 搜索关键词： | 数字 时间 转换器 辅助 锁相环 电路 | ||
【主权项】：
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