[发明专利]用于可变长度整数译码的指令集在审
| 申请号： | 201780057071.7 | 申请日： | 2017-08-15 |
| 公开（公告）号： | CN109716291A | 公开（公告）日： | 2019-05-03 |
| 发明（设计）人： | J·D·吉尔福德;V·戈帕尔 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | G06F9/30 | 分类号： | G06F9/30 |
| 代理公司： | 上海专利商标事务所有限公司 31100 | 代理人： | 黄嵩泉;钱慰民 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 用于可变长度整数(varint)译码的指令集以及相关联的方法和装置。这些指令集包括用于对varint进行编码和解码的指令，并且可被包括作为用于诸如基于x86和基于Arm的架构之类的处理器架构的指令集架构(ISA)以及其他ISA的部分。在一个方面中，指令包括：varint尺寸编码指令，用于对varint的尺寸进行编码；varint编码指令，用于对varint进行编码；varint尺寸解码指令，用于对经编码的varint的尺寸进行解码；以及varint解码指令，用于对经编码的varint进行解码。varint编码尺寸指令和varint编码指令可被组合在单个指令中。类似地，varint解码尺寸指令和varint解码指令可被组合在单个指令中。在一个方面中，指令使用可变长度量(VLQ)编码方案，在该方案下，varint被编码为一个或多个八位位组。 | ||
| 搜索关键词： | 解码 解码指令 指令集 可变 指令 编码指令 长度整数 尺寸指令 单个指令 译码 处理器架构 方法和装置 指令集架构 八位位组 尺寸编码 长度量 架构 关联 | ||
【主权项】：
1.一种处理器，包括：电路和逻辑中的至少一者，被配置成用于实现指令的集合，所述指令的集合是用于所述处理器的指令集架构(ISA)的部分，所述指令的集合与对可变长度整数(varint)进行编码和解码有关，所述指令的集合包括，varint尺寸编码指令，用于对varint的尺寸进行编码；varint编码指令，用于对varint进行编码；varint尺寸解码指令，用于对经编码的varint的尺寸进行解码；以及varint解码指令，用于对经编码的varint进行解码。
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