[发明专利]一种多DSP嵌入式计算机系统的同步方法在审
申请号: | 201711304530.5 | 申请日: | 2017-12-11 |
公开(公告)号: | CN108303914A | 公开(公告)日: | 2018-07-20 |
发明(设计)人: | 王可;曾永红;王晓璐;刘慧婕;李岩 | 申请(专利权)人: | 天津津航计算技术研究所 |
主分类号: | G05B19/042 | 分类号: | G05B19/042 |
代理公司: | 天津翰林知识产权代理事务所(普通合伙) 12210 | 代理人: | 王瑞 |
地址: | 300300 天津市*** | 国省代码: | 天津;12 |
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摘要: | 本发明公开了一种多DSP嵌入式计算机系统的同步方法。通过对多DSP嵌入式计算机系统主、从逻辑关系的划分,完成对多DSP嵌入式计算机系统各个DSP处理器的角色定位,保证系统的合理架构与合理工作流程设计,能够最优的实现系统算法流程中控制功能与运算功能的协同,提高系统运算效率。在逻辑架构与硬件设计支持下,实现了支持多DSP嵌入式计算机系统软件同步的具体方法:所有从DSP完成前置工作后,通过Flag I/O向主DSP发送握手信号,主DSP接收到所有从DSP握手信号后,再同时向所有从DSP发出统一执行命令,实现多DSP的同步、同时运行。 | ||
搜索关键词: | 嵌入式计算机系统 握手信号 工作流程设计 保证系统 控制功能 逻辑关系 逻辑架构 系统算法 系统运算 硬件设计 同步的 与运算 前置 架构 发送 协同 角色 统一 | ||
【主权项】:
1.一种多DSP嵌入式计算机系统的同步方法,其特征在于该方法包括以下步骤:(1)硬件设计:在多DSP嵌入式计算机系统中规划出由一个DSP作为主处理器,其余全部DSP作为从处理器的逻辑关系,并在主DSP与每一个从DSP之间都增加一路Flag I/O的硬件连接;(2)上电自举:系统上电复位,多DSP嵌入式计算机系统中的多个DSP从嵌入式计算机系统硬件设计配套的固化存储器中读取程序,将程序搬到DSP本身的内存RAM中,开始运行程序,完成上电自举;(3)初始化和自检:每个DSP运行各自的软件程序,完成硬件初始化,完成对DSP本身和外设的自检;(4)DSP对自身身份进行判断,如果是从DSP,则运行从DSP算法流程;如果是主DSP,则运行主DSP算法流程;(5)对于从DSP,在完成初始化和自检的前置工作之后,正式进入算法流程前,从DSP执行软件同步程序代码段:a)首先通过与主DSP之间的Flag I/O发送握手信号量给主DSP;b)随后进入等待状态,并持续读取主DSP返回的Flag I/O状态;c)待主DSP返回的Flag I/O状态置高时,跳出同步程序代码段,执行后续算法程序;(6)对于主DSP,在完成初始化和自检的前置工作之后,正式进入算法流程前,主DSP执行软件同步程序代码段:a)首先主DSP持续监听所有从DSP与主DSP连接的Flag I/O状态;b)每当有一个从DSP Flag I/O状态置高时,则记录下该从DSP,继续监听其他从DSP状态;c)当所有从DSP连接的Flag I/O状态都置高时,说明所有从DSP都完成了前置工作,则同时向所有从DSP发送Flag I/O信号量;d)主DSP跳出同步程序代码段,执行后续算法程序。
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