[发明专利]一种数据采集环状电路设计实现方法和结构在审
| 申请号： | 201710881699.0 | 申请日： | 2017-09-26 |
| 公开（公告）号： | CN107633145A | 公开（公告）日： | 2018-01-26 |
| 发明（设计）人： | 赵元 | 申请（专利权）人： | 郑州云海信息技术有限公司 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50;G06F13/42 |
| 代理公司： | 济南信达专利事务所有限公司37100 | 代理人： | 张靖 |
| 地址： | 450000 河南省郑州市*** | 国省代码： | 河南;41 |
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| 摘要： | 本发明公开了一种数据采集环状电路设计实现方法和结构，高速协同协议处理器芯片内部的每个模块，通过调试接口模块，将调试数据按照确定的规格打包进入环状并行数据总线，调试数据串行通过各模块，环状并行数据总线的数据流通过每个模块时，各模块都将本模块的调试数据加载到环状并行数据总线帧数据结构的固定位置上，环状并行数据总线将所有模块的调试数据串行输出到调试接口模块中，调试接口模块将所有调试数据顺序输出至芯片外。本发明以较小的资源实现了并行多节点大数据量的可靠传输采集，实现了整个系统设计可测性的提升，显著地减轻从硬件到软件调试压力，在电路级的设计上根本性的解决了大规模数据采集消耗资源过大，效率降低，成本增加过多的问题。 | ||
| 搜索关键词： | 一种 数据 采集 环状 电路设计 实现 方法 结构 | ||
【主权项】：
一种数据采集环状电路设计实现方法，其特征在于，高速协同协议处理器芯片内部的每个模块，通过调试接口模块，将调试数据按照确定的规格打包进入环状并行数据总线，调试数据串行通过各模块，环状并行数据总线的数据流通过每个模块时，各模块都将本模块的调试数据加载到环状并行数据总线帧数据结构的固定位置上，最终，环状并行数据总线将所有模块的调试数据串行输出到调试接口模块中，调试接口模块将所有调试数据顺序输出至芯片外。
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