[发明专利]系统级芯片在审
| 申请号： | 201710155461.X | 申请日： | 2017-03-16 |
| 公开（公告）号： | CN106682535A | 公开（公告）日： | 2017-05-17 |
| 发明（设计）人： | 周清睿 | 申请（专利权）人： | 周清睿 |
| 主分类号： | G06F21/76 | 分类号： | G06F21/76;G06F21/72;G06F21/12;G06F21/60;G06F21/55;G06F15/78 |
| 代理公司： | 北京远大卓悦知识产权代理事务所(普通合伙)11369 | 代理人： | 史霞 |
| 地址： | 430080 湖北省武汉市青*** | 国省代码： | 湖北;42 |
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| 摘要： | 本发明公开了一种系统级芯片(SoC)，包括：中央处理器(CPU)；现场可编程门阵列(FPGA)，其中设有加密/解密模块，CPU通过系统总线连接到所述加密/解密模块；以及片上存储器，其通过系统总线连接到所述加密/解密模块并且其中存储有预设的加密和/或不加密的系统程序和执行所述系统程序所需的数据。所述加密/解密模块：在系统程序和/或数据以预定的地址映射关系存储于片上存储器中时，将CPU发送的地址解密为系统程序和/或数据在片上存储器中的实际地址；并且/或者在系统程序和/或数据是加密的时，对CPU经由FPGA从片上存储器读取的系统程序和/或数据进行解密，以及对从CPU经由FPGA传输到片上存储器的数据进行加密。 | ||
| 搜索关键词： | 系统 芯片 | ||
【主权项】：
一种系统级芯片(SoC)，包括：中央处理器(CPU)；现场可编程门阵列(FPGA)，其中设有加密/解密模块，所述CPU通过系统总线连接到所述加密/解密模块；以及片上存储器，其通过系统总线连接到所述FPGA的所述加密/解密模块并且其中存储有预设的加密和/或不加密的系统程序和执行所述系统程序所需的数据；其中所述加密/解密模块执行如下的加密/解密操作：在所述系统程序和/或所述数据以预定的地址映射关系存储于所述片上存储器中的情况下，将所述CPU发送的地址解密为所述系统程序和/或所述数据在所述片上存储器中的实际地址；并且/或者在所述系统程序和/或所述数据是加密的情况下，对所述CPU经由所述FPGA从所述片上存储器读取的所述系统程序和/或所述数据进行解密，以及对从所述CPU经由所述FPGA传输到所述片上存储器的数据进行加密。
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