[发明专利]基于级联形式的CNN卷积核硬件设计方法在审
| 申请号： | 201710052545.0 | 申请日： | 2017-01-24 |
| 公开（公告）号： | CN106845635A | 公开（公告）日： | 2017-06-13 |
| 发明（设计）人： | 张川;徐炜鸿;尤肖虎 | 申请（专利权）人： | 东南大学 |
| 主分类号： | G06N3/063 | 分类号： | G06N3/063;G06N3/04;G06N3/08 |
| 代理公司： | 南京苏高专利商标事务所(普通合伙)32204 | 代理人： | 柏尚春 |
| 地址： | 210018*** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明公开了一种基于级联形式的CNN卷积核硬件设计方法，包括以下步骤(1)定义卷积基本矩阵，并采用硬件实现，得到卷积基本模块；(2)将线性卷积用快速卷积算法以矩阵相乘的形式进行表示，并按照表示形式将卷积基本模块进行级联，形成级联卷积模块；(3)在级联卷积模块中加入通过加法器实现的加法矩阵，以实现并行处理、偏置值的加法计算以及2维卷积和，得到最终快速卷积核。本发明相比传统的2维卷积核，本发明在降低了硬件需求的同时提高了系统的速率；其次，避免了不同尺寸的快速卷积核需要重新设计硬件架构的缺点。 | ||
| 搜索关键词： | 基于 级联 形式 cnn 卷积 硬件 设计 方法 | ||
【主权项】：
一种基于级联形式的CNN卷积核硬件设计方法，其特征在于，包括以下步骤：(1)定义卷积基本矩阵，并采用硬件实现，得到卷积基本模块；(2)将线性卷积用快速卷积算法以矩阵相乘的形式进行表示，并按照表示形式将卷积基本模块进行级联，形成级联卷积模块；(3)在级联卷积模块中加入通过加法器实现的加法矩阵，以实现并行处理、偏置值的加法计算以及2维卷积和，得到最终快速卷积核。
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