[实用新型]一种基于FPGA的算法加速卡有效
| 申请号： | 201620794457.9 | 申请日： | 2016-07-27 |
| 公开（公告）号： | CN205983466U | 公开（公告）日： | 2017-02-22 |
| 发明（设计）人： | 胥鹏 | 申请（专利权）人： | 四川迈实通科技有限责任公司 |
| 主分类号： | G06F13/40 | 分类号： | G06F13/40 |
| 代理公司： | 成都九鼎天元知识产权代理有限公司51214 | 代理人： | 沈强 |
| 地址： | 621000 四川省绵*** | 国省代码： | 四川;51 |
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| 摘要： | 本实用新型公开了一种基于FPGA的算法加速卡，包括FPGA核心处理器和转发模块，查找模块和高速缓存模块的输入端相连接，所述高速缓存模块通过RS232数据接口与FPGA核心处理器相连接，所述FPGA核心处理器的表面上还设置有数据接口，且数据接口通过复位模块与PCIE接口模块相连接，所述FPGA核心处理器的输出端连接有网络接口模块，且所述网络接口模块连接有接口控制模块，所述转发模块的输出端与数据采集卡相连接，数据采集卡通过存储器与数据库相连接。本实用新型是在充分吸收了网络安全隔离新技术和硬件规则匹配技术等基础上完成，通过专用通信设备、自定义协议格式、并配合应用层数据提取，满足了新一代网络隔离技术的需求，采用硬件规则匹配技术加快了数据处理速度。 | ||
| 搜索关键词： | 一种 基于 fpga 算法 加速卡 | ||
【主权项】：
一种基于FPGA的算法加速卡，其特征在于包括一块FPGA核心处理器和一个转发模块，所述FPGA核心处理器内设置有时钟异步处理模块与寄存器配置模块；所述FPGA核心处理器外围设置有查找模块和高速缓存模块，所述查找模块通过高速缓存模块连接到FPGA核心处理器的数据接口（10）；所述FPGA核心处理器的表面设置有一个数据接口（7），所述数据接口（7）通过设置在FPGA核心处理器外的复位模块连接到与PCIE接口模块连接；所述FPGA核心处理器的数据输出端连接到网络接口模块，所述网络接口模块通过接口控制模块连接到转发模块，转发模块与FPGA核心处理器进行数据连接；所述转发模块的输出端与数据采集卡相连接，数据采集卡通过存储器与数据库相连接；所述FPGA核心处理器与查找模块分别连接到电源模块。
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