[实用新型]集成电路和解码器有效
| 申请号： | 201620540205.3 | 申请日： | 2016-05-16 |
| 公开（公告）号： | CN205881468U | 公开（公告）日： | 2017-01-11 |
| 发明（设计）人： | 申请（专利权）人： | ||
| 主分类号： | G11C13/00 | 分类号： | G11C13/00 |
| 代理公司： | 北京市金杜律师事务所11256 | 代理人： | 王茂华,张宁 |
| 地址： | 意大利阿格*** | 国省代码： | 暂无信息 |
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| 摘要： | 本公开涉及集成电路和解码器。该集成电路包括相变存储器(PCM)单元、耦合至PCM单元的阵列的位线。集成电路还包括第一解码器电路，具有多个晶体管，其具有第一导电型、耦合在一起并耦合至多个位线中给定位线、配置为将程序电流脉冲注入选择的PCM单元。另外，集成电路包括第二解码器电路，具有多个晶体管，其具有第二导电型、耦合在一起并耦合至给定位线、配置为在程序电流脉冲结束时对给定位线放电。 | ||
| 搜索关键词： | 集成电路 解码器 | ||
【主权项】：
一种集成电路，其特征在于，包括：相变存储器PCM单元的阵列；耦合至所述PCM单元的阵列的多个位线；第一解码器电路，包括具有第一导电型的相应的多个晶体管，所述多个晶体管耦合在一起并耦合至所述多个位线中的给定的位线，所述多个晶体管被配置为将程序电流脉冲注入从所述PCM单元的阵列中选择的PCM单元；以及第二解码器电路，包括具有第二导电型的多个晶体管，所述多个晶体管耦合在一起并耦合至所述给定的位线，所述多个晶体管被配置为在所述程序电流脉冲结束时对所述给定的位线放电。
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