[发明专利]一种多架构CPU能耗控制系统有效
申请号: | 201611247505.3 | 申请日: | 2016-12-29 |
公开(公告)号: | CN106843444B | 公开(公告)日: | 2019-12-17 |
发明(设计)人: | 康真健 | 申请(专利权)人: | 苏州浪潮智能科技有限公司 |
主分类号: | G06F1/324 | 分类号: | G06F1/324;G06F1/3234;G06F15/173;G06F15/177 |
代理公司: | 37205 济南舜源专利事务所有限公司 | 代理人: | 张亮 |
地址: | 215100 江苏省苏州市吴*** | 国省代码: | 江苏;32 |
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摘要: | 本发明提供一种多架构CPU能耗控制系统,包括:计算板卡组及Ufrq调节单元;计算板卡组包括:第一计算板卡,第二计算板卡,第三计算板卡和第四计算板卡;第一CPU,第二CPU,第三CPU,第四CPU,第五CPU,第六CPU,第七CPU,第八CPU分别设有Ufrq模块;Ufrq调节单元用于调节每个Ufrq模块的输出功率,使Ufrq模块的输出功率在0至45%之间波动。这样随着系统总体功率的降低,系统能效逐渐有相应的提升,并控制Ufrq模块在0至45%之间波动可以有效的大幅降低系统能耗,而对系统处理能力小幅降低,达到了降低能耗的效果。本发明内容易于实现,经过测试对服务器能耗降低效果明显,无需对硬件及软件系统做任何调整。 | ||
搜索关键词: | 一种 架构 cpu 能耗 控制系统 | ||
【主权项】:
1.一种多架构CPU能耗控制系统,其特征在于,包括:计算板卡组及核心外频率调节单元;计算板卡组包括:第一计算板卡,第二计算板卡,第三计算板卡和第四计算板卡;/n第一计算板卡包括:第一CPU,第二CPU,第一总线开关,第一选择总线开关,第一比较器;/n第二计算板卡包括:第三CPU,第四CPU,第二总线开关,第二选择总线开关,第二比较器;/n第一总线开关设有第一总线开关输入A端,第一总线开关输出B端,第一总线开关电平输入端OE;第一总线开关电平输入端OE用于根据接收的电平高低控制第一总线开关的通断;/n第一比较器设有正极输入端,负极输入端及输出端;/n第一选择总线开关设有第一选择总线开关输入A端,第一选择总线开关输入S端,第一选择总线开关输出B0端,第一选择总线开关输出B1端;/n第一CPU和第二CPU分别与第一总线开关输入A端连接,第一总线开关的输出B端与第一选择总线开关输入A端连接,第一选择总线开关输入S端与第一比较器的输出端连接;/n第二总线开关设有第二总线开关输入A端,第二总线开关输出B端,第二总线开关电平输入端OE;第二总线开关电平输入端OE用于根据接收的电平高低控制第二总线开关的通断;/n第二比较器设有正极输入端,负极输入端及输出端;/n第二选择总线开关设有第二选择总线开关输入A端,第二选择总线开关输入S端,第二选择总线开关输出B0端,第二选择总线开关输出B1端;/n第三CPU和第四CPU分别与第二总线开关输入A端连接,第二总线开关的输出B端与第二选择总线开关输入A端连接,第二选择总线开关输入S端与第二比较器的输出端连接;第一选择总线开关输出B1端与第二选择总线开关输出B1端连接;/n第三计算板卡包括:第五CPU,第六CPU,第三总线开关,第三选择总线开关,第三比较器;/n第四计算板卡包括:第七CPU,第八CPU,第四总线开关,第四选择总线开关,第四比较器;/n第三总线开关设有第三总线开关输入A端,第三总线开关输出B端,第三总线开关电平输入端OE;第三总线开关电平输入端OE用于根据接收的电平高低控制第三总线开关的通断;/n第三比较器设有正极输入端,负极输入端及输出端;/n第三选择总线开关设有第三选择总线开关输入A端,第三选择总线开关输入S端,第三选择总线开关输出B0端,第三选择总线开关输出B1端;/n第五CPU和第六CPU分别与第三总线开关输入A端连接,第三总线开关的输出B端与第三选择总线开关输入A端连接,第三选择总线开关输入S端与第三比较器的输出端连接;/n第四总线开关设有第四总线开关输入A端,第四总线开关输出B端,第四总线开关电平输入端OE;第四总线开关电平输入端OE用于根据接收的电平高低控制第四总线开关的通断;/n第四比较器设有正极输入端,负极输入端及输出端;/n第四选择总线开关设有第四选择总线开关输入A端,第四选择总线开关输入S端,第四选择总线开关输出B0端,第四选择总线开关输出B1端;/n第七CPU和第八CPU分别与第四总线开关输入A端连接,第四总线开关的输出B端与第四选择总线开关输入A端连接,第四选择总线开关输入S端与第四比较器的输出端连接;第三选择总线开关输出B1端与第四选择总线开关输出B1端连接;/n第一选择总线开关输出B0端,第二选择总线开关输出B0端,第三选择总线开关输出B0端,第四选择总线开关输出B0端同时连接;/n第一CPU,第二CPU,第三CPU,第四CPU,第五CPU,第六CPU,第七CPU,第八CPU分别设有核心外频率模块;/n核心外频率调节单元用于调节每个核心外频率模块的输出功率,使核心外频率模块的输出功率在0至45%之间波动。/n
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