[发明专利]一种闪存单元制作方法在审
申请号: | 201611038891.5 | 申请日: | 2016-11-21 |
公开(公告)号: | CN106409836A | 公开(公告)日: | 2017-02-15 |
发明(设计)人: | 张超然;罗清威;李赟;周俊 | 申请(专利权)人: | 武汉新芯集成电路制造有限公司 |
主分类号: | H01L27/11517 | 分类号: | H01L27/11517;H01L21/265;H01L21/306 |
代理公司: | 上海申新律师事务所31272 | 代理人: | 俞涤炯 |
地址: | 430205 湖北*** | 国省代码: | 湖北;42 |
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摘要: | 本发明提供一种闪存单元制作方法,其中,提供一硅衬底,硅衬底定义有存储器件区及外围电路区,存储器件区与外围电路区之间通过浅沟槽结构进行隔离,硅衬底上表面覆盖一多晶硅层,还包括以下步骤步骤S1、于多晶硅层进行离子注入,并进行退火;步骤S2、去除预定厚度的位于存储器件区上方的多晶硅层,预定厚度小于多晶硅层的厚度;步骤S3、对剩余的多晶硅层进行减薄,使多晶硅层表面平坦。其技术方案有益效果在于,在制作闪存单元过程中可控制多晶硅片的存储区层和外围电路层研磨厚度保持一致,避免研磨中存储区层和外围电路层出现高度差,造成后续对外围电路层的多晶硅去除时易对闪存单元的硅衬底造成损伤的问题。 | ||
搜索关键词: | 一种 闪存 单元 制作方法 | ||
【主权项】:
一种闪存单元制作方法,其特征在于,提供一硅衬底,所述硅衬底定义有存储器件区及外围电路区,所述存储器件区与所述外围电路区之间通过浅沟槽结构进行隔离,所述硅衬底上表面覆盖一多晶硅层,还包括以下步骤:步骤S1、于所述多晶硅层进行离子注入,并进行退火;步骤S2、去除预定厚度的位于所述存储器件区上方的所述多晶硅层,所述预定厚度小于所述多晶硅层的厚度;步骤S3、对剩余的所述多晶硅层进行减薄,使所述多晶硅层表面平坦。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的