[发明专利]应用于时间交织模数转换器的校准算法在审
| 申请号： | 201610948338.9 | 申请日： | 2016-10-26 |
| 公开（公告）号： | CN106385257A | 公开（公告）日： | 2017-02-08 |
| 发明（设计）人： | 周磊;陈莲 | 申请（专利权）人： | 苏州迅芯微电子有限公司 |
| 主分类号： | H03M1/10 | 分类号： | H03M1/10;H03M1/12 |
| 代理公司： | 北京联瑞联丰知识产权代理事务所(普通合伙)11411 | 代理人： | 黄冠华 |
| 地址： | 215028 江苏省苏州市*** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明提供一种应用于时间交织模数转换器的校准算法，包括通过多路子模数转换器ADC对模拟信号进行采样；通过现场可编程门阵列FPGA(Field‑Programmable Gate Array，简称FPGA)对采样后得到的数字信号进行处理，计算误差值；根据计算的误差值进行实时反馈调节；重复上述步骤直至误差值收敛至固定值。本发明采用统计分析与反馈调节的方法，通过FPGA实时处理采样数据，从而得到三项误差值(偏移失配误差、增益失配误差、采样时间间隔失配误差)，然后利用误差值进行实时反馈调节，直到误差值收敛，最终完成时间交织ADC的校准，从而有效的降低了校准算法的复杂度，实现了实时校准，同时节省了的硬件资源的损耗。 | ||
| 搜索关键词： | 应用于 时间 交织 转换器 校准 算法 | ||
【主权项】：
一种应用于时间交织模数转换器的校准算法，其特征在于，包括：通过多路子模数转换器ADC对模拟信号进行采样；通过现场可编程门阵列FPGA对采样得到的数字信号计算误差值；根据所述计算的误差值进行实时反馈调节；重复上述步骤直至误差值收敛至固定值。
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