[发明专利]基数为4的折叠内插高速模数转换器有效
| 申请号： | 201610945690.7 | 申请日： | 2016-10-26 |
| 公开（公告）号： | CN106533446B | 公开（公告）日： | 2023-10-13 |
| 发明（设计）人： | 周磊;陈冬梅 | 申请（专利权）人： | 苏州迅芯微电子有限公司 |
| 主分类号： | H03M1/20 | 分类号： | H03M1/20 |
| 代理公司： | 北京三聚阳光知识产权代理有限公司 11250 | 代理人： | 李博洋 |
| 地址： | 215028 江苏省苏州市*** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明提供一种基数为4的折叠内插高速模数转换器，包括第一比较器单元、第二比较器单元、模拟处理器单元以及至少两级折叠内插单元，其中，至少两级折叠内插单元中的每级折叠内插单元分别包括折叠放大器和内插网络，各折叠放大器的折叠因子均为4，各内插网络的内插因子均为4。本发明通过设置至少两级折叠内插单元，且折叠因子和内插因子均为4，从而简化了折叠内插ADC系统的结构，且由于ADC输出的每一比特对应的量化曲线都是2的幂次，因此折叠曲线和量化曲线有着自然对应的关系，因此，不仅简化了低位的编码，还省略了高位的粗量化，同时提高了系统的精度和速度、避免过多增加规模和功耗导致的不稳定因素。 | ||
| 搜索关键词： | 基数 折叠 内插 高速 转换器 | ||
【主权项】：
一种基数为4的折叠内插高速模数转换器，其特征在于，包括第一比较器单元、第二比较器单元、模拟处理器单元以及至少两级折叠内插单元，所述至少两级折叠内插单元中的每级折叠内插单元分别包括折叠放大器和内插网络，各折叠放大器的折叠因子均为4，各内插网络的内插因子均为4；所述模拟处理器单元用于处理折叠放大器输出的信号，并将处理后的信号发送给第一比较器单元，所述第一比较器单元还接收所述内插网络输出的信号，所述第二比较器单元接收至少两级折叠内插单元输出的信号。
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