[发明专利]一种调整时钟的方法及控制器有效
| 申请号： | 201510781814.8 | 申请日： | 2015-11-13 |
| 公开（公告）号： | CN106708167B | 公开（公告）日： | 2019-11-29 |
| 发明（设计）人： | 王斌 | 申请（专利权）人： | 北京兆易创新科技股份有限公司 |
| 主分类号： | G06F1/08 | 分类号： | G06F1/08 |
| 代理公司： | 11319 北京润泽恒知识产权代理有限公司 | 代理人： | 刘祥景<国际申请>=<国际公布>=<进入 |
| 地址： | 100083 北京市海淀*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明实施例提供了一种调整时钟的方法及控制器，其中的方法具体包括：进行存储器的读写测试，以得到使控制器从所述存储器中准确采样数据的延时长度；设置配置寄存器的延时参数为所述延时长度；控制读数据采样电路根据所述延时参数生成实际采样时钟，以根据所述实际采样时钟从所述存储器中采样数据。本发明实施例能够使控制器可以准确从存储器中采样数据，并且可以降低芯片设计流程的难度，减小开发时间且降低生产成本。 | ||
| 搜索关键词： | 存储器 采样数据 控制器 采样时钟 延时参数 延时 芯片设计流程 采样电路 调整时钟 读写测试 设置配置 读数据 寄存器 减小 开发 | ||
【主权项】：
1.一种调整时钟的方法，其特征在于，应用于控制器，所述控制器包括配置寄存器、信号产生电路、读写预处理电路以及读数据采样电路，所述读数据采样电路包括异步处理模块、时钟门控电路和时钟延时电路，所述时钟门控电路与所述配置寄存器和所述信号产生电路分别相连，所述时钟延时电路与所述配置寄存器和时钟门控电路分别相连，所述异步处理模块分别与时钟延时电路、存储器相连；包括:/n进行存储器的读写测试，以得到使控制器从所述存储器中准确采样数据的延时长度；/n设置配置寄存器的延时参数为所述延时长度；/n控制读数据采样电路根据所述延时参数生成实际采样时钟，以异步处理模块根据所述实际采样时钟从所述存储器中采样数据，并对所述存储器的数据进行采样得到的采样结果进行缓存，确认采样结果稳定后将采样结果根据所述控制器的工作时钟，返回至所述读写预处理电路；/n其中，控制读数据采样电路根据所述延时参数生成实际采样时钟，包括：/n所述时钟延时电路接收理想采样时钟，并接收所述配置寄存器配置的延时参数，以使所述理想采样时钟根据所述延时参数对理想采样时钟进行延时，产生实际采样时钟，所述配置寄存器配置的延时参数为所述延时长度；/n其中，所述理想采样时钟是按照以下方式得到的：/n所述时钟门控电路接收所述控制器的工作时钟，并接收所述信号产生电路传递的读数据有效标志，使该工作时钟根据该读数据有效标识产生与采样结果个数相同的上升沿，以得到理想采样时钟，其中，所述读数据有效标志根据存储器发送的地址信息和命令信息产生。/n
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