[发明专利]金属栅制备方法有效
| 申请号: | 201510061913.9 | 申请日: | 2015-02-05 | 
| 公开(公告)号: | CN105990238B | 公开(公告)日: | 2019-03-12 | 
| 发明(设计)人: | 赵简;曹轶宾;王杭萍 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司 | 
| 主分类号: | H01L21/8238 | 分类号: | H01L21/8238;H01L21/28 | 
| 代理公司: | 上海申新律师事务所 31272 | 代理人: | 俞涤炯 | 
| 地址: | 201203 上海市*** | 国省代码: | 上海;31 | 
| 权利要求书: | 查看更多 | 说明书: | 查看更多 | 
| 摘要: | 本发明涉及半导体制备技术领域,具体提供了一种金属栅制备方法,本发明是基于gate last的一种HKMG制备工艺,通过减薄其中一器件区的样本栅并在其顶部制备硬掩膜层,之后在其他器件区制备金属栅并进行研磨时,硬掩膜层可有效起到保护其下方的样本栅免受损伤,进而提高了研磨后器件表面的均匀性。 | ||
| 搜索关键词: | 金属 制备 方法 | ||
【主权项】:
                1.一种金属栅制备方法,其特征在于,包括如下步骤:步骤S1、提供一衬底,所述衬底表面覆盖有介质层,所述介质层中形成有第一栅槽和第二栅槽,所述第一栅槽内设置有第一样本栅,所述第二栅槽内设置有第二样本栅;第一样本栅的高度小于介质层的厚度,第二样本栅的高度等于介质层的厚度;步骤S2、制备一层硬掩膜层覆盖在第一样本栅和第二样本栅的顶部,并将第一栅槽内位于第一样本栅之上的间隙空间完全予以填充;步骤S3、完全移除位于第二样本栅之上的硬掩膜层,同时移除第一样本栅之上的一部分硬掩膜层并在第一样本栅之上保留部分硬掩膜层;步骤S4、对所述介质层进行研磨,移除部分第二样本栅并将第一样本栅之上的余下的硬掩膜层进行部分移除;步骤S5、刻蚀以完全移除第二栅槽内余下的第二样本栅;步骤S6、填充金属至第二栅槽内并进行研磨,籍由第一样本栅之上的残留的硬掩膜层保障第一样本栅在研磨过程中免受损伤。
            
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            该专利技术资料仅供研究查看技术是否侵权等信息,商用须获得专利权人授权。该专利全部权利属于中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司,未经中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司许可,擅自商用是侵权行为。如果您想购买此专利、获得商业授权和技术合作,请联系【客服】
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                    H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
                
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