[发明专利]一种3D NAND闪存结构及其制作方法有效
申请号: | 201410854360.8 | 申请日: | 2014-12-31 |
公开(公告)号: | CN105810683B | 公开(公告)日: | 2019-05-28 |
发明(设计)人: | 熊涛;刘钊;许毅胜;舒清明 | 申请(专利权)人: | 上海格易电子有限公司;北京兆易创新科技股份有限公司 |
主分类号: | H01L27/1157 | 分类号: | H01L27/1157;H01L27/1158 |
代理公司: | 北京品源专利代理有限公司 11332 | 代理人: | 胡彬;邓猛烈 |
地址: | 201203 上海市浦东新区张*** | 国省代码: | 上海;31 |
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摘要: | 本发明公开了一种3D NAND闪存结构及其制作方法。该方法包括:提供衬底,衬底表面形成有多个阵列串单元,所述阵列串单元之间设有暴露出衬底的源极沟槽,阵列串单元包括多个堆叠的第一氧化介质层和牺牲介质层;对源极沟槽中暴露出的衬底进行离子注入,形成公共源极;刻蚀去除牺牲介质层,并在氧化介质层内壁形成栅极,且在源极沟槽内形成第二氧化介质层;刻蚀源极沟槽底部的第二氧化介质层、公共源极和衬底,形成P阱连接沟槽;对P阱连接沟槽中暴露出的衬底进行离子注入,形成P+;在P阱连接沟槽和源极沟槽内形成沟槽引线。采用自对准离子注入法在各个源极沟槽内均形成P+和N+,不仅节约了生产成本,还提高了电路的稳定性和可靠度。 | ||
搜索关键词: | 一种 nand 闪存 结构 及其 制作方法 | ||
【主权项】:
1.一种3D NAND闪存结构的制作方法,其特征在于,包括:提供P阱衬底,所述P阱衬底表面形成有多个阵列串单元,所述阵列串单元之间设有暴露出所述P阱衬底的源极沟槽,所述阵列串单元包括多晶硅、多晶硅隔离介质层及多个交错堆叠的第一氧化介质层和牺牲介质层,所述多晶硅隔离介质层形成于所述多晶硅的内部,所述牺牲介质层形成于相邻的第一氧化介质层之间,所述多个交错堆叠的第一氧化介质层和牺牲介质层位于所述多晶硅的两侧;对源极沟槽中暴露出的P阱衬底进行N型离子注入,形成公共源极;刻蚀去除所述牺牲介质层,并在氧化介质层内壁形成栅极,且在源极沟槽内形成第二氧化介质层;刻蚀源极沟槽底部的第二氧化介质层、公共源极和P阱衬底,形成P阱连接沟槽;对所述P阱连接沟槽中暴露出的P阱衬底进行离子注入,形成P型重掺杂;在所述P阱连接沟槽和所述源极沟槽内形成沟槽引线。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
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