[发明专利]数字锁相环DPLL、控制DPLL的方法和使用DPLL的超低功率收发器有效
| 申请号： | 201410532951.3 | 申请日： | 2014-10-10 |
| 公开（公告）号： | CN104796140B | 公开（公告）日： | 2019-05-10 |
| 发明（设计）人： | 金尚骏;尹石柱;洪永骏;朴炯;李康润 | 申请（专利权）人： | 三星电子株式会社;成均馆大学校产学协力团 |
| 主分类号： | H03L7/18 | 分类号： | H03L7/18 |
| 代理公司： | 北京铭硕知识产权代理有限公司 11286 | 代理人： | 王兆赓;胡江海 |
| 地址： | 韩国京畿*** | 国省代码： | 韩国;KR |
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| 摘要： | 提供一种数字锁相环DPLL、控制DPLL的方法和使用DPLL的超低功率收发器。一种锁相环(PLL)包括：计数器，被构造为在屏蔽时间期间测量振荡器的压控振荡器(VCO)信息；频率调谐器，被构造为基于通过将VCO信息与目标频率信息进行比较而获得的比较结果，将振荡器的频率调谐为目标频率。 | ||
| 搜索关键词： | 数字 锁相环 dpll 控制 方法 使用 功率 收发 | ||
【主权项】：
1.一种锁相环PLL，包括：计数器，被构造为在屏蔽时间期间测量振荡器的压控振荡器VCO信息；频率调谐器，被构造为基于通过将VCO信息与目标频率信息进行比较而获得的比较结果，将振荡器的频率调谐为目标频率，其中，响应于振荡器的频率与目标频率匹配，所述PLL被构造为将功率提供给频率调谐器以用于保持振荡器的频率与目标频率匹配。
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