[发明专利]一种基于类脑协处理器的计算机系统有效
| 申请号: | 201410034973.7 | 申请日: | 2014-01-24 |
| 公开(公告)号: | CN104809501B | 公开(公告)日: | 2018-05-01 |
| 发明(设计)人: | 施路平;李佩;邓磊;裴京;徐海峥;潘龙法;陆达 | 申请(专利权)人: | 清华大学 |
| 主分类号: | G06N3/02 | 分类号: | G06N3/02 |
| 代理公司: | 北京安博达知识产权代理有限公司11271 | 代理人: | 徐国文 |
| 地址: | 10008*** | 国省代码: | 北京;11 |
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| 摘要: | 本发明提供了一种基于类脑协处理器的计算机系统,该系统包括的基于神经形态网络的协处理器集存储和处理于一体,采用分布式存储和并行协同处理的方式,特别适于处理非形式化问题和非结构化信息,也可以处理形式化问题和结构化信息,大幅度加快计算机在处理类脑计算、人工智能等问题时的速度,降低能耗,极大改善容错能力,减少编程复杂度,从而提高计算机性能。 | ||
| 搜索关键词: | 一种 基于 类脑协 处理器 计算机系统 | ||
【主权项】:
一种基于类脑协处理器的计算机系统,所述计算机系统包括分别与数据总线连接的计算机的处理器和存储器,其特征在于:所述数据总线通过数据接口与所述类脑协处理器连接;所述类脑协处理器包括处理模块和/或辅助模块;所述处理模块为通过神经形态电路接收输入信号,存储和处理信息,完成类脑计算并输出结果的处理模块;所述处理模块包括扩展模块、关联模块、固化功能网络模块和/或可配置功能网络模块;所述辅助模块包括存储模块、编码器、解码器和比对模块;所述编码器、处理模块和解码器依次连接;所述存储模块的输出端和解码器的输出端均与比对模块的输入端连接;所述神经形态电路为阶层结构的电路,按硬件结构划分或软件配置划分;所述神经形态电路包括多组单层神经形态电路;单层神经形态电路包括:接口、类神经元胞体器件和类突触阵列;所述类突触阵列包括:横向导线、纵向导线、设于总线导线末端的类树突器件、嵌于横向导线和纵向导线交叉点处的类突触器件和设于横向导线末端的类轴突器件;所述处理器和存储器用于处理形式化问题和/或结构化信息;所述处理器、所述存储器和所述类脑协处理器用于处理非形式化问题和/或形式化问题,非结构化信息和/或结构化信息。
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