[实用新型]混合中频数字化仪有效
| 申请号： | 201320832186.8 | 申请日： | 2013-12-17 |
| 公开（公告）号： | CN203596015U | 公开（公告）日： | 2014-05-14 |
| 发明（设计）人： | 万传彬;陆建国;王林;陈刚;李华;王云;樊宏坤 | 申请（专利权）人： | 成都国蓉科技有限公司 |
| 主分类号： | G06F13/40 | 分类号： | G06F13/40 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 610000 *** | 国省代码： | 四川;51 |
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| 摘要： | 本实用新型公开了一种混合中频数字化仪，包括FPGA，FPGA和ADC数据采集模块、时钟分配模块均相连，所述ADC数据采集模块和时钟分配模块相连，FPGA和DSP、SPI口、RS232串口均相连，DSP和100M以太网、RS232串口相连。FPGA和DSP的连接点之间还连接有外部存储器接口。所述外部存储器接口和NORFlash或者同步动态随机存储器或者NANDFlash相连。本实用新型设置ADC数据采集模块对数据进行采样，再传送到FPGA实现对数据的进一步识别和分选，传输给SPI接口处和DSP处进行窄带和宽带的并发任务处理，通过DSP对数据进行压缩，提高数据的存储深度，并利用DSP的强大的处理数据能力对数据进行回放，同时和以太网交互，实现宽带的任务处理，减少了数据上传时间、提高了信号处理能力、方便快捷。 | ||
| 搜索关键词： | 混合 中频 数字化 | ||
【主权项】：
混合中频数字化仪，其特征在于：包括FPGA，所述FPGA连接有ADC数据采集模块和时钟分配模块，所述ADC数据采集模块和时钟分配模块相连 ，FPGA还连接有DSP、SPI口和RS232串口，所述DSP连接有100M以太网和RS232串口。
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