[实用新型]一种多相非交叠时钟电路有效
| 申请号： | 201320040075.3 | 申请日： | 2013-01-25 |
| 公开（公告）号： | CN203135818U | 公开（公告）日： | 2013-08-14 |
| 发明（设计）人： | 张文杰;谢亮;金湘亮 | 申请（专利权）人： | 湘潭芯力特电子科技有限公司 |
| 主分类号： | H03K3/78 | 分类号： | H03K3/78;H03K5/00 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 411100 湖南省湘潭*** | 国省代码： | 湖南;43 |
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| 摘要： | 本实用新型公开了一种多相非交叠时钟电路。所述多相非交叠时钟电路包括延迟模块，周期脉冲产生模块，多个反向器和多个RS触发器，所述延迟模块输入端与周期脉冲产生模块其中一个输入端连接作为主时钟输入端口，延迟模块输出端接至周期脉冲产生模块另一输入端，周期脉冲产生模块输出端接至各RS触发器的置位端，各反向器的输入端分别作为多相时钟的输入端口，各反向器输出端分别接至对应RS触发器的另一个输入端，各RS触发器的输出端分别作为多相非交叠时钟的输出端口。本实用新型结构简单、占用芯片面积小、可靠性高能对与主时钟同步的多相时钟进行处理。 | ||
| 搜索关键词： | 一种 多相 交叠 时钟 电路 | ||
【主权项】：
一种多相非交叠时钟电路，其特征在于：其包括延迟模块（1），周期脉冲产生模块（2），多个反向器（3）和多个RS触发器（4），各反向器（3）结构相同，其中： 所述延迟模块（1）的输入端与周期脉冲产生模块（2）其中一个输入端连接，延迟模块（1）的输出端接至周期脉冲产生模块（2）的另一输入端；周期脉冲产生模块（2）的输出端接至各RS触发器（4）的置位端，各反向器（3）的输入端分别作为多相时钟的输入端口，各反向器（3）的输出端分别接至各RS触发器（4）的复位端，各RS触发器（4）的输出端分别作为多相非交叠时钟的输出端口。
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