[发明专利]一种移位寄存器、栅极驱动电路及显示装置有效
申请号: | 201210109686.9 | 申请日: | 2012-04-13 |
公开(公告)号: | CN102682689A | 公开(公告)日: | 2012-09-19 |
发明(设计)人: | 吴仲远;段立业 | 申请(专利权)人: | 京东方科技集团股份有限公司 |
主分类号: | G09G3/20 | 分类号: | G09G3/20;G09G3/36;G11C19/28 |
代理公司: | 北京天昊联合知识产权代理有限公司 11112 | 代理人: | 罗建民;陈源 |
地址: | 100015 *** | 国省代码: | 北京;11 |
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摘要: | 本发明提供一种移位寄存器,包括复数个级联的移位寄存器子单元,每个所述移位寄存器子单元均包括第一至第三薄膜晶体管、第十一薄膜晶体管、第一电容以及用于控制第二薄膜晶体管的导通或截止的第一复位控制模块,并且,除第一级移位寄存器子单元以外,其余移位寄存器子单元中的第二薄膜晶体管栅极控制端分别与其上一级移位寄存器子单元中的第三薄膜晶体管栅极控制端相连。相应地,还提供一种包括所述移位寄存器的栅极驱动电路以及包括所述栅极驱动电路的显示装置。本发明所述移位寄存器与现有技术相比,其可靠性得到极大的提高,且占用面积较小。 | ||
搜索关键词: | 一种 移位寄存器 栅极 驱动 电路 显示装置 | ||
【主权项】:
一种移位寄存器,包括复数个级联的移位寄存器子单元,其特征在于,所述移位寄存器子单元包括:第一薄膜晶体管,其栅极与第一节点相连,源极与信号输出端相连,漏极与第一时钟信号输入端相连;第二薄膜晶体管,其栅极与第二薄膜晶体管栅极控制端相连,源极与电平信号输入端相连,漏极与信号输出端相连;第三薄膜晶体管,其栅极与第三薄膜晶体管栅极控制端相连,源极与电平信号输入端相连,漏极与信号输出端相连;第十一薄膜晶体管,其栅极与第二时钟信号输入端相连,源极与第一节点相连,漏极与信号输入端相连;第一电容,连接在第一节点与信号输出端之间;第一复位控制模块,分别与第十一薄膜晶体管的源极、电平信号输入端、信号输入端、第一时钟信号输入端、第二时钟信号输入端以及第二薄膜晶体管栅极控制端相连,用于控制第二薄膜晶体管的导通或截止;并且,除第一级移位寄存器子单元以外,其余移位寄存器子单元中的第二薄膜晶体管栅极控制端分别与其上一级移位寄存器子单元中的第三薄膜晶体管栅极控制端相连,即每一级移位寄存器子单元中的第一复位控制模块还用于控制上一级移位寄存器子单元中第三薄膜晶体管的导通或截止。
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