[发明专利]包括以潜在大切换等待时间为特征的存储器元件的高效数据存储器件无效

专利信息
申请号: 201180072605.6 申请日: 2011-07-27
公开(公告)号: CN103703513A 公开(公告)日: 2014-04-02
发明(设计)人: E.奥尔登特利奇;G.塞鲁西 申请(专利权)人: 惠普发展公司;有限责任合伙企业
主分类号: G11C7/10 分类号: G11C7/10;G11C7/22
代理公司: 中国专利代理(香港)有限公司 72001 代理人: 刘金凤;徐红燕
地址: 美国德*** 国省代码: 美国;US
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摘要: 在本申请中公开的一个示例是电子数据存储器件,其包括存储器元件的一个或多个阵列,每个存储器元件包括:数据存储介质,其通过导致切换的力或梯度向所述数据存储介质的施加而在两个不同的状态之间切换;顶部控制元件和底部控制元件,导致切换的力或梯度通过顶部控制元件和底部控制元件被施加;以及反馈信号。该数据存储器件还包括对接收的数据进行编码的错误控制编码编码器和读/写控制器,读/写控制器通过向存储器元件的所述一个或多个阵列施加导致切换的力直至反馈信号指示写操作已完成或直至导致切换的力或梯度已被施加达最大施加时间而将从错误控制编码编码器接收的已编码数据写入多个存储器元件。
搜索关键词: 包括 潜在 切换 等待时间 特征 存储器 元件 高效 数据 存储 器件
【主权项】:
一种数据存储器件,包括:存储器元件的一个或多个阵列,每个存储器元件包括       数据存储介质,其通过导致切换的力或梯度向所述数据存储介质的施加而在至少两个不同的状态之间切换,       顶部控制元件和底部控制元件,所述导致切换的力或梯度通过所述顶部控制元件和底部控制元件被施加,以及       反馈信号;错误控制编码编码器,其对接收的数据进行编码;以及读/写控制器,其通过向存储器元件的所述一个或多个阵列施加导致切换的力或梯度直至反馈信号指示写操作已完成或直至导致切换的力或梯度已被施加达最大施加时间而将从所述错误控制编码编码器接收到的已编码数据写入多个存储器元件。
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