[发明专利]一种基于FPGA实现多路I2C总线端口扩展的方法无效
| 申请号： | 201110171251.2 | 申请日： | 2011-06-23 |
| 公开（公告）号： | CN102243619A | 公开（公告）日： | 2011-11-16 |
| 发明（设计）人： | 王东锋;杨林;朱力;陈伟峰;张睿;钱瑞杰;张天晶 | 申请（专利权）人： | 天津光电通信技术有限公司 |
| 主分类号： | G06F13/38 | 分类号： | G06F13/38 |
| 代理公司： | 天津中环专利商标代理有限公司 12105 | 代理人： | 莫琪 |
| 地址： | 300211*** | 国省代码： | 天津;12 |
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| 摘要： | 本发明涉及一种基于FPGA实现多路I2C总线端口扩展的方法，用于通信系统的主设备和从设备之间通信，将主设备的主控MCU通过高速并口连接一个FPGA，经编程构成FPGA内部电路，FPGA内部电路包括MCU接口模块和多路I2C接口模块；由FPGA扩展出来的I2C端口完全符合I2C总线协议，在以I2C总线通信的系统中，通过在主设备中使用本发明的通信端口扩展的方法，可以极大的提高主设备和从设备或者从器件的通信速度。 | ||
| 搜索关键词： | 一种 基于 fpga 实现 i2c 总线 端口 扩展 方法 | ||
【主权项】：
一种基于FPGA实现多路I2C总线端口扩展的方法，用于通信系统的主设备和从设备之间通信，其特征在于，将主设备的主控MCU通过高速并口连接一个FPGA，经编程构成FPGA内部电路， FPGA内部电路包括MCU接口模块和多路I2C接口模块；所述MCU接口模块用于FPGA和主控MCU外围总线的通信，主控MCU和FPGA之间采用高速并口进行通信，每次通信传输一个Byte的数据；主控MCU和FPGA之间的并口通信采用如下定义：ADDR_BUS[15:0] ：地址总线，表示FPGA中寄存器的地址；DATA_BUS[7:0] ：双向的数据总线；WRB ：写控制信号，低电平有效；RDB ：读控制信号，低电平有效；RD_IRQ ：读中断信号，低电平有效； 所述多路I2C接口模块包括多路I2C接口；每路I2C接口用于连接外部I2C控制器和外部I2C总线；I2C接口主要由Start/Stop及SCL发生器的状态机和主状态机组成；Start/Stop及SCL发生器的状态机用于产生开始，停止信号，以及SCL信号；主状态机用于执行发送和接收操作。
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