[发明专利]一种NRZI解码并行设计电路无效
| 申请号： | 201110004876.X | 申请日： | 2011-01-11 |
| 公开（公告）号： | CN102592636A | 公开（公告）日： | 2012-07-18 |
| 发明（设计）人： | 左耀华 | 申请（专利权）人： | 上海华虹集成电路有限责任公司 |
| 主分类号： | G11B20/10 | 分类号： | G11B20/10 |
| 代理公司： | 上海东创专利代理事务所(普通合伙) 31245 | 代理人： | 曹立维 |
| 地址： | 201203 上海*** | 国省代码： | 上海;31 |
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| 摘要： | 本发明提供一种NRZI解码并行设计电路，由一个二选一选择器和八个同或运算单元构成，输入位宽为8比特。二选一选择器在同步信号sync的控制下输入NRZI解码运算的初始值，八个同或运算单元XNOR采样外部输入的八位数据，同时进行同或运算并产生运算结果。通过本发明提供的方案，能降低电路工作时钟频率，同时有效降低电路的功耗。 | ||
| 搜索关键词： | 一种 nrzi 解码 并行 设计 电路 | ||
【主权项】：
一种NRZI解码并行设计电路，由二选一选择器和多个同或运算单元构成，其特征在于同步信号sync控制二选一选择器的输入NRZI解码电路的初始值，多个同或运算模单元采样外部输入数据进行同或运算。
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