[发明专利]存储模块以及存储用辅助模块有效
| 申请号： | 200910177393.2 | 申请日： | 2009-09-30 |
| 公开（公告）号： | CN101719380A | 公开（公告）日： | 2010-06-02 |
| 发明（设计）人： | 汤浅香 | 申请（专利权）人： | 巴比禄股份有限公司 |
| 主分类号： | G11C11/34 | 分类号： | G11C11/34;G11C11/401;G11C11/4063 |
| 代理公司： | 北京林达刘知识产权代理事务所 11277 | 代理人： | 刘新宇;陈立航 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
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| 摘要： | 本发明提供一种存储模块以及存储用辅助模块。在存储模块中，即使从存储控制器输出的存储体地址、行地址、列地址的位数分别与用于确定成为访问对象的存储单元的存储体地址、行地址、列地址的位数不匹配的情况下，也能够访问存储模块的所有的存储单元，并且使存储模块正常进行动作。在存储模块(100)中，地址生成电路(120)使用从存储控制器(12)输出的行地址的最高位，生成确定成为访问对象的存储单元时所不足的存储体地址的最高位(BA2)，将该最高位(BA2)输出到SDRAM(110)。动作模式检测部(130)检测存储控制器(12)的动作模式。开关控制部(140)根据所检测出的动作模式来切换开关(128)。 | ||
| 搜索关键词： | 存储 模块 以及 辅助 | ||
【主权项】：
一种存储模块，具备：存储器，其具有多个存储体，该存储体具备以矩阵状排列的多个存储单元，该存储器根据从存储控制器输入的规定位数的存储体地址、规定位数的行地址、规定位数的列地址，来确定成为访问对象的存储单元；地址生成电路，其在从上述存储控制器输出的存储体地址的位数、行地址的位数、列地址的位数的总和与用于确定成为上述访问对象的存储单元的存储体地址的位数、行地址的位数、列地址的位数的总和相等，并且，从上述存储控制器输出的行地址的位数比用于确定成为上述访问对象的存储单元的行地址的位数多1位，并且，从上述存储控制器输出的存储体地址的位数比用于确定成为上述访问对象的存储单元的存储体地址的位数少1位时，能够使用从上述存储控制器输出的行地址的最高位来生成用于确定成为上述访问对象的存储单元的存储体地址的最高位，并输出到上述存储器；动作模式检测部，其检测从上述存储控制器访问上述存储器的动作模式是第一动作模式还是第二动作模式；以及控制部，其根据由上述动作模式检测部检测出的动作模式，控制上述地址生成电路。
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