[发明专利]在多通道大容量存储装置中的ECC功能块布局无效
| 申请号： | 200880102125.8 | 申请日： | 2008-08-05 |
| 公开（公告）号： | CN101772807A | 公开（公告）日： | 2010-07-07 |
| 发明（设计）人： | A·沃根;J·B·罕;S·贾亚钱德兰 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | G11B20/18 | 分类号： | G11B20/18;G11C29/42;G06F11/10 |
| 代理公司： | 中国专利代理(香港)有限公司 72001 | 代理人： | 朱海煜;徐予红 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 多通道存储装置可包括从主机装置接收输入数据的主机控制器和在下游存储之前存储输入数据和关联的纠错数据的缓冲存储器。在缓冲存储器下游的多存储通道可在非易失性存储介质上存储至少一个存储通道中的输入数据和关联的纠错数据。主机控制器和缓冲存储器之间的纠错引擎可在来自主机装置的输入数据上执行纠错编码以产生关联的纠错数据以存储在缓冲存储器中。这样的纠错引擎可防止在缓冲存储器中和存储通道中出现数据错误。 | ||
| 搜索关键词： | 通道 容量 存储 装置 中的 ecc 功能块 布局 | ||
【主权项】：
一种多通道存储装置，包括：从主机装置接收输入数据的主机控制器；在下游存储之前存储所述输入数据和关联的纠错数据的缓冲存储器；在所述缓冲存储器下游的多存储通道，用于在非易失性存储介质上存储至少一个所述存储通道中的所述输入数据和关联的纠错数据；以及所述主机控制器和所述缓冲存储器之间的纠错引擎，用于在来自所述主机装置的所述输入数据上执行纠错编码以产生所述关联的纠错数据以存储在所述缓冲存储器中。
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