[发明专利]数字锁相环和消除毛刺的方法有效
| 申请号： | 200810211585.6 | 申请日： | 2008-09-19 |
| 公开（公告）号： | CN101369814A | 公开（公告）日： | 2009-02-18 |
| 发明（设计）人： | 万辰 | 申请（专利权）人： | 华为技术有限公司 |
| 主分类号： | H03L7/06 | 分类号： | H03L7/06;H03L7/085;H03K5/13;H03K5/1254 |
| 代理公司： | 北京三高永信知识产权代理有限责任公司 | 代理人： | 何文彬 |
| 地址： | 518129广东省*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明公开了一种数字锁相环和消除毛刺的方法，属于电子技术领域。所述数字锁相环包括触发器和延迟线。所述方法包括：触发器从触发端接收延迟线输出的延迟后的时钟信号，并从输入端接收延迟线内的第一延迟单元选择端的信号，第一延迟单元的选择端在触发器触发前处于置1状态；触发器利用延迟后的时钟信号采样第一延迟单元选择端的信号，并输出采样后的信号给延迟线内的第二延迟单元的选择端，第二延迟单元的选择端在触发器触发后处于置1的状态。本发明通过触发器利用延迟后的时钟信号对第一延迟单元的选择端的信号进行采样，将采样的结果作为第二延迟单元的选择端的信号，有效地避免了在时钟边沿处更新延迟阶数时发生跳变带来的毛刺。 | ||
| 搜索关键词： | 数字 锁相环 消除 毛刺 方法 | ||
【主权项】：
1.一种数字锁相环，其特征在于，所述数字锁相环包括：触发器和延迟线；所述触发器，用于利用延迟后的时钟信号采样所述延迟线内的第一延迟单元选择端的信号，并输出所述采样后的信号给所述延迟线内的第二延迟单元的选择端，所述第一延迟单元的选择端在所述触发器触发前处于置1状态，所述第二延迟单元的选择端在所述触发器触发后处于置1的状态，所述触发器的触发端与所述延迟线的输出端相连，输入端与所述第一延迟单元的选择端相连，输出端与所述第二延迟单元的选择端相连；所述延迟线，用于在所述触发器触发前，以所述第一延迟单元对应的延迟阶数，对时钟输入信号进行延迟得到延迟后的时钟信号，在所述触发器触发后，以所述第二延迟单元对应的延迟阶数，对所述时钟输入信号进行延迟得到延迟后的时钟信号。
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