[发明专利]图像处理电路、显示装置及打印装置无效
| 申请号： | 200810188783.5 | 申请日： | 2008-08-12 |
| 公开（公告）号： | CN101458813A | 公开（公告）日： | 2009-06-17 |
| 发明（设计）人： | 小野义之;泽崎高;斋藤明 | 申请（专利权）人： | 精工爱普生株式会社 |
| 主分类号： | G06T1/20 | 分类号： | G06T1/20;G06T1/60;G09G5/00 |
| 代理公司： | 中科专利商标代理有限责任公司 | 代理人： | 汪惠民 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
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| 摘要： | 图像处理电路包括：存储装置，其存储有构成并列配置的多个图形图像的各个像素的位置及其像素值；第一乘法运算装置，其将存储在上述存储装置中的各个位置的像素值以及表示各个位置的像素值的输入图像数据中所包括的像素值，在每一个分别对应的上述位置相乘；差值输出装置，其输出将上述输入图像数据中包括的各位置的像素值从该输入图像数据中包括的最大像素值减去后的像素值；第二乘法运算装置，其将在上述输入图像数据中包含的各个位置的像素值或者根据该输入图像数据成为图像的背景的背景图像数据中包括的各个位置的像素值，与由上述差值输出装置反转后的像素值，在每一个分别对应的上述位置相乘；和加法装置，其将上述第一乘法运算装置的乘法运算结果和上述第二乘法运算装置的乘法运算结果在每一个分别对应的上述位置相加，并作为输出图像数据输出。 | ||
| 搜索关键词： | 图像 处理 电路 显示装置 打印 装置 | ||
【主权项】：
1. 一种图像处理电路，其特征在于，包括：存储装置，其存储有构成被并列配置的多个图形图像的各个像素的位置和其像素值；第一乘法运算装置，其将存储在上述存储装置中的各个位置的像素值和表示各个位置的像素值的输入图像数据中所包括的像素值，在每一个分别对应的上述位置上进行相乘；差值输出装置，其输出从该输入图像数据中包括的最大像素值减去上述输入图像数据中包括的各位置的像素值后的像素值；第二乘法运算装置，其将在上述输入图像数据中包含的各个位置的像素值或者根据该输入图像数据成为图像的背景的背景图像数据中包括的各个位置的像素值，与由上述差值输出装置反转后的像素值，在每一个分别对应的上述位置上进行相乘；和加法装置，其将上述第一乘法运算装置的乘法运算结果和上述第二乘法运算装置的乘法运算结果在每一个分别对应的上述位置上进行相加，并作为输出图像数据输出。
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