[发明专利]锁相环电路有效
| 申请号： | 200810113690.6 | 申请日： | 2008-05-29 |
| 公开（公告）号： | CN101594147A | 公开（公告）日： | 2009-12-02 |
| 发明（设计）人： | 刘渭;李伟;任鹏;林庆龙;王阳元 | 申请（专利权）人： | 中芯国际集成电路制造（北京）有限公司 |
| 主分类号： | H03L7/18 | 分类号： | H03L7/18;H03L7/08;H03L7/099;H03L7/093;H03K19/173 |
| 代理公司： | 北京集佳知识产权代理有限公司 | 代理人： | 吴靖靓;李 丽 |
| 地址： | 100176北京市*** | 国省代码： | 北京;11 |
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| 摘要： | 一种锁相环电路，包括：时间检测器，用于输出第一数字信号，所述第一数字信号在时间域上用于表示参考时钟信号的周期累加值与反馈时钟信号的周期累加值的差，所述反馈时钟信号的周期累加值在时间域上表示为合成时钟信号的周期累加值与分频数的乘积；除法器，用于将所述第一数字信号除以分频数，输出第二数字信号；传输函数为(α(z-1)+ρ)/(z-1)的数字环路滤波器，用于累加所述第二数字信号，输出数控信号；传输函数为(z-1)/(1-z-1)的数控振荡器，用于根据所述数控信号产生合成时钟信号。所述锁相环电路具有结构简单、低功耗和性能稳定的特点。 | ||
| 搜索关键词： | 锁相环 电路 | ||
【主权项】：
1.一种锁相环电路，其特征在于，包括：时间检测器，用于输出第一数字信号，所述第一数字信号在时间域上用于表示参考时钟信号的周期累加值与反馈时钟信号的周期累加值的差，所述反馈时钟信号的周期累加值在时间域上表示为合成时钟信号的周期累加值与分频数的乘积；除法器，用于将所述时间检测器输出的第一数字信号除以分频数，输出第二数字信号；数字环路滤波器，用于累加所述除法器输出的第二数字信号，输出数控信号，所述数字环路滤波器的传输函数为![]()
α、ρ为控制参数；数控振荡器，用于根据所述数字环路滤波器输出的数控信号产生合成时钟信号，所述数控振荡器的传输函数为![]()
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