[发明专利]半导体存储器件无效

专利信息
申请号: 200810092160.8 申请日: 2008-04-10
公开(公告)号: CN101286361A 公开(公告)日: 2008-10-15
发明(设计)人: 饭田真久;大田清人 申请(专利权)人: 松下电器产业株式会社
主分类号: G11C11/406 分类号: G11C11/406
代理公司: 北京市金杜律师事务所 代理人: 王茂华
地址: 日本*** 国省代码: 日本;JP
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摘要: 发明提供一种半导体存储器件,包括:多个存储块;多个更新块计数器,生成2个以上存储块的块地址,选择所述多个存储块中进行更新的2个以上存储块;更新字线计数器,生成对所述2个以上的存储块共用的共用字线地址;以及仲裁电路,根据所述2个以上块地址和所述共用字线地址,生成至少一个第一字线地址,并进行仲裁以使得在对从外部供给的第二字线地址表示的字线进行访问的期间,进行所述至少一个第一字线地址表示的各条字线的更新。根据本发明,在不使用存储体的半导体存储器件中,能够同时执行来自外部的访问和内部更新,而不在安装有该半导体存储器件的系统一侧考虑内部更新地址,并实现面积的减小和低耗电。
搜索关键词: 半导体 存储 器件
【主权项】:
1.一种半导体存储器件,其特征在于,包括:多个存储块,分别具有配置为矩阵状的多个存储单元、与所述多个存储单元的行分别对应的多条字线、与所述多个存储单元的列分别对应的多条位线、以及与所述多个存储单元的列分别对应的多个读出放大器,其中所述多条字线中同时仅有一条字线被激活;多个更新块计数器,生成2个以上存储块的块地址,选择所述多个存储块中进行更新的2个以上存储块;更新字线计数器,生成对所述2个以上的存储块共用的共用字线地址;以及仲裁电路,根据所述2个以上块地址和所述共用字线地址来生成至少一个第一字线地址,并进行仲裁以使得在对从外部供给的第二字线地址表示的字线进行访问期间进行所述至少一个第一字线地址表示的各条字线的更新。
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