[发明专利]非易失性半导体存储器无效

专利信息
申请号: 200710162018.1 申请日: 2007-09-29
公开(公告)号: CN101154688A 公开(公告)日: 2008-04-02
发明(设计)人: 清水达雄;村冈浩一 申请(专利权)人: 株式会社东芝
主分类号: H01L29/792 分类号: H01L29/792;H01L29/51;H01L27/115
代理公司: 中国国际贸易促进委员会专利商标事务所 代理人: 王永刚
地址: 日本*** 国省代码: 日本;JP
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摘要: 以往的MONOS是在SiN中蓄积电荷的结构,但是电荷蓄积量不充分,无法取得大的阈值电压变化幅度,在向HfO2、ZrO2、TiO2中导入La系元素的技术中,难以实现基于掺杂剂的导入的电荷高密度化。一种非易失性半导体存储器,具有将介电常数比氮化硅膜充分高的Ti氧化物、Zr氧化物、Hf氧化物等金属氧化物作为母材材料,为了使其中产生电子出入成为可能的捕获能级,适量添加价数为大2价(VI价)以上的高价数物质的结构的电荷蓄积层。
搜索关键词: 非易失性 半导体 存储器
【主权项】:
1.一种非易失性半导体存储器,其特征在于:由隔开成为沟道区的间隔设置有源区和漏区的半导体衬底、两端盖在所述源区上和所述漏区上并且形成在所述沟道区上的栅层叠物构成;所述栅层叠物依次层叠:形成在所述沟道区上的第一绝缘层;在包含钛(Ti)、锆(Zr)和铪(Hf)中的至少一个的氧化物电介质膜中,导入价数比所述Ti、所述Zr或所述Hf更高的物质Tc、Re、Ru、Os、Rh、Ir、Pd、Pt、Co、以及Ni中的至少一个作为添加物质的电荷蓄积层;具有比所述第一绝缘层更高的介电常数的第二绝缘层;存储器栅电极。
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