[发明专利]半导体装置的制造方法无效

专利信息
申请号: 200710142754.0 申请日: 2003-09-23
公开(公告)号: CN101179048A 公开(公告)日: 2008-05-14
发明(设计)人: 田原贤治 申请(专利权)人: 株式会社瑞萨科技
主分类号: H01L21/768 分类号: H01L21/768
代理公司: 中国专利代理(香港)有限公司 代理人: 浦柏明;刘宗杰
地址: 日本*** 国省代码: 日本;JP
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摘要: 发明提供一种半导体装置的制造方法。在半导体衬底上形成第1层布线层之后,在该第1层布线层上形成氮化硅膜。接着在氮化硅膜上形成第2层间绝缘膜,蚀刻该第2层间绝缘膜并使氮化硅膜露出后,通过用含氟气体蚀刻已露出的氮化硅膜来形成通路孔。接下来对已露出的第1铜层进行等离子体处理,除去含有含氟聚合物的污染物。然后在通路孔的内面堆积第2阻挡金属膜和第2铜层,而形成通路插头。由此提供一种通过从已露出的铜表面除去含有含氟聚合物的污染物,使铜表面处于形成自然氧化膜的状态,从而能够抑制铜的腐蚀的半导体装置的制造方法。
搜索关键词: 半导体 装置 制造 方法
【主权项】:
1.一种具有铜布线的半导体装置的制造方法,其特征在于,具有:在上述铜布线上形成绝缘膜的工序;用含氟气体蚀刻上述绝缘膜,设置直至达到上述铜布线的开孔部的工序;在设置上述开孔部的工序之后,不停止等离子体放电,在同一室内连续地对在上述开孔部的底部已露出的上述铜布线的表面在暴露到大气中之前进行等离子体处理的工序;在上述开孔部的内面,使用CVD法或溅射法形成阻挡金属层的工序;经由上述阻挡金属层,在上述开孔部的内部使用电镀法形成铜的工序;以及使用化学机械研磨法,研磨上述铜和上述阻挡金属层的工序。
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