[发明专利]一种比特加扰并行处理方法和装置有效
| 申请号： | 200710089292.0 | 申请日： | 2007-03-20 |
| 公开（公告）号： | CN101022286A | 公开（公告）日： | 2007-08-22 |
| 发明（设计）人： | 赵延宾;徐心明;陈旭;文小芳 | 申请（专利权）人： | 中兴通讯股份有限公司 |
| 主分类号： | H04B1/707 | 分类号： | H04B1/707;H04L1/00 |
| 代理公司： | 北京安信方达知识产权代理有限公司 | 代理人： | 龙洪;霍育栋 |
| 地址： | 518057广东省深圳市南山*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明公开了一种比特加扰并行处理方法和装置，适用于宽带码分多址系统的高速下行分组接入领域，将比特加扰扰码的取值扩展到负无穷大；再将16比特相位值存储器中的比特加扰扰码序列对应的相位值向正无穷大方向移动N减M个相位，并进行存储，其中N为并行数据序列的比特数，M为第一个并行数据序列中位于低比特的无效比特数；输入并行数据序列，利用移动后的比特加扰扰码序列与所述并行数据序列完成加扰操作。本发明通过在扰码序列前插入部分多余相位的方式，只需要16个二选一的选择器，从而降低比特加扰并行处理结构的复杂度。 | ||
| 搜索关键词： | 一种 比特 并行 处理 方法 装置 | ||
【主权项】：
1、一种比特加扰并行处理方法，适用于宽带码分多址系统的高速下行分组接入领域，其特征在于，包括以下步骤：A、将比特加扰扰码的取值扩展到负无穷大；B、将16比特相位值存储器中的初始相位值向正无穷大方向移动N减M个相位，并进行存储，其中N为并行数据序列的比特数，M为第一个并行数据序列中位于低比特的无效比特数；C、输入并行数据序列，利用移动后的比特加扰扰码序列与所述并行数据序列完成加扰操作。
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