[发明专利]分频器有效
| 申请号： | 200580026565.6 | 申请日： | 2005-07-27 |
| 公开（公告）号： | CN101006645A | 公开（公告）日： | 2007-07-25 |
| 发明（设计）人： | 普拉山特·德凯特;多米尼克斯·M·W·利艾特 | 申请（专利权）人： | 皇家飞利浦电子股份有限公司 |
| 主分类号： | H03K23/50 | 分类号： | H03K23/50;H03K23/54 |
| 代理公司： | 中科专利商标代理有限责任公司 | 代理人： | 齐晓寰 |
| 地址： | 荷兰艾*** | 国省代码： | 荷兰;NL |
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| 摘要： | 一种提供奇数分频因数的分频器，包括提供偶数分频因数的二进制计数器(10)，所述偶数分频因数是小于奇数分频因数的第一偶数，二进制计数器具有时钟输入端用于接收具有频率的周期性时钟信号(Ck)。电路还包括与所述二进制计数器相连的计数结束电路(20)，用于产生在时钟信号(Ck)的每一个偶数周期后出现的时钟(Ck)周期的计数结束信号(EOC)，计数结束信号(EOC)输入到计数器(10)的输入端(IN)。电路还包括与二进制计数器和时钟信号(Ck)相连的输出发生器(30)，输出发生器(30)产生输出信号(OUT)，输出信号(OUT)的频率与奇数分频因数对频率信号(Ck)分频后的频率实际上相等。 | ||
| 搜索关键词： | 分频器 | ||
【主权项】：
1.一种提供奇数分频因数的分频器，包括：二进制计数器(10)，用于提供偶数分频因数，所述偶数分频因数由所述奇数分频因数减一而得到，所述二进制计数器具有时钟输入端，用于接收具有频率的周期性时钟信号(Ck)；计数结束电路(20)，与所述二进制计数器相连，用于产生在所述时钟信号(Ck)的每一个所述偶数周期后出现的时钟(Ck)周期的计数结束信号(EOC)，所述计数结束信号(EOC)输入到所述计数器(10)的输入端(IN)；以及输出发生器(30)，与所述二进制计数器和所述时钟信号(Ck)相连，所述输出发生器(30)产生输出信号(OUT)，其中所述输出信号的频率与按照所述奇数分频因数对频率信号(Ck)分频后的频率实际上相等。
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