[发明专利]存储器控制设备和存储器控制方法无效

专利信息
申请号: 200510055411.1 申请日: 2005-03-17
公开(公告)号: CN1779664A 公开(公告)日: 2006-05-31
发明(设计)人: 松井孝夫;冈田诚之;伊藤大介;畑井田诚;植木俊和 申请(专利权)人: 富士通株式会社
主分类号: G06F12/12 分类号: G06F12/12;G06F12/08
代理公司: 北京三友知识产权代理有限公司 代理人: 李辉
地址: 日本神*** 国省代码: 日本;JP
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摘要: 存储器控制设备和存储器控制方法。目标数据的地址信息在开始由反向驱逐进行高速缓存逐出处理时被存储在ELA寄存器中,并且当由处理器请求获得的数据的地址在ELA寄存器中存在时,请求处理单元连续地再次进行数据获取处理。目标数据的地址信息在开始由处理器进行自主移出时被存储在EWB缓存中,并且当被反向驱逐的数据的地址在EWB缓存中存在时,停止由反向驱逐进行的高速缓存逐出处理。
搜索关键词: 存储器 控制 设备 方法
【主权项】:
1.一种存储器控制设备,连接在主存储器和各自具有高速缓存存储器的多个处理器之间,用于控制所述处理器对所述主存储器的访问,所述存储器控制设备包括:标签信息存储单元,具有多个存储所述高速缓存存储器中保存的数据的地址信息的块,其中所述块可被有效或者无效;请求处理单元,用于处理所述处理器的存储器访问请求,并且当所述标签信息存储单元的任一个所述块必须被无效时,用于请求其高速缓存存储器中保存有与所述标签信息存储单元的将被无效的块中存储的数据相同的待逐出数据的处理器执行高速缓存逐出处理,所述高速缓存逐出处理将所述待逐出的数据从所述高速缓存存储器逐出到所述主存储器中;逐出目标数据存储单元,用于当所述请求处理单元请求所述处理器进行所述高速缓存逐出处理时,在一条目中存储待逐出数据的地址信息,直到所述处理器完成所述高速缓存逐出处理;和再次执行决定单元,用于在所述请求处理单元确定用于获得所述处理器请求的数据的获取路线决定处理时,检查存储在逐出目标数据存储单元中的地址信息,并且如果任何一条所述条目中包括所请求的数据的地址信息,则使所述请求处理单元再次进行数据的获取路线决定处理。
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