[发明专利]在使用推测存储器支持的冗余多线程系统中为错误检测缓冲未检验存储无效
| 申请号： | 200480039645.0 | 申请日： | 2004-12-23 |
| 公开（公告）号： | CN1902593A | 公开（公告）日： | 2007-01-24 |
| 发明（设计）人： | S·K·赖因哈德特;S·S·穆克赫尔吉;J·S·埃默;C·T·韦弗 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | G06F11/14 | 分类号： | G06F11/14 |
| 代理公司： | 中国专利代理(香港)有限公司 | 代理人： | 程天正;张志醒 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 公开一种多线程体系结构，其在使用推测存储器支持的冗余多线程系统中为错误检测缓冲未检验存储。特别地，通过使用推测存储器支持，以便缓冲主线程存储直到它们能够与它们的从线程对应部分相比较为止，提高了SRT处理器的性能。在存储器系统中缓冲这些存储允许它们从存储缓冲区中去除。由于推测存储器系统将具有比存储缓冲区更大的容量，在将要强迫主线程停止之前可以缓冲额外的存储。这将导致在线程之间松散的增加，并且从而增加了性能。 | ||
| 搜索关键词： | 使用 推测 存储器 支持 冗余 多线程 系统 错误 检测 缓冲 检验 存储 | ||
【主权项】：
1.一种方法，包括：作为主线程和从线程并行地执行相应的指令线程；将来自在主线程中执行的指令的结果和来自在从线程中执行的指令的结果保存到存储器中；比较在存储器中保存的结果；以及基于比较结果提交单组指令到存储器状态。
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