[发明专利]可编程序逻辑装置无效
| 申请号： | 200480008783.2 | 申请日： | 2004-03-31 |
| 公开（公告）号： | CN1768324A | 公开（公告）日： | 2006-05-03 |
| 发明（设计）人： | 笹尾勤;井口幸洋 | 申请（专利权）人： | 财团法人北九州产业学术推进机构 |
| 主分类号： | G06F7/00 | 分类号： | G06F7/00 |
| 代理公司： | 中国专利代理(香港)有限公司 | 代理人： | 杨凯;叶恺东 |
| 地址： | 日本福冈*** | 国省代码： | 日本;JP |
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| 摘要： | 提供一种能够按照目标逻辑函数，改变逻辑函数存储器间的输入线数及路线数，并将存储容量控制到必要最小限地进行最优化设计的可编程序逻辑装置。将逻辑函数存储器(4)串联并按序排列，并存储LUT。从外部输入线输入到各逻辑函数存储器(4)的输入变量。在两个逻辑函数存储器(4)之间，根据连接存储器(6)存储的连接信息，连接电路(5)进行前级的逻辑函数存储器(4)的输出线或外部输入线与后级的逻辑函数存储器(4)的输入线的连接。如果按照目标逻辑函数改写连接信息，就能再构成连接电路，并可改变输入线数及路线数。对照逻辑函数将路线数和输入线数的比最优化，能将存储容量抑制到必要最小限。 | ||
| 搜索关键词： | 程序逻辑 装置 | ||
【主权项】：
1.一种可编程序逻辑装置，其特征在于包含以下结构：用以存储逻辑函数的查阅表的、串联编号排列的逻辑函数存储器；输入对于所述各逻辑函数存储器的输入变量的多个外部输入线；存储连接信息的连接存储器，所述连接信息用以在两个所述逻辑函数存储器之间，选择从前级的所述逻辑函数存储器的输出线或者所述外部输入线中连接到后级的所述逻辑函数存储器的各输入线的线；以及在两个所述逻辑函数存储器之间，可根据所述连接存储器的输出，进行前级的所述逻辑函数存储器的输出线或所述外部输入线和后级的所述逻辑函数存储器的输入线的连接关系的再构成的连接电路。
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