[实用新型]数据信号处理器的海量静态存储器扩展结构无效
申请号: | 200420012135.1 | 申请日: | 2004-06-23 |
公开(公告)号: | CN2777641Y | 公开(公告)日: | 2006-05-03 |
发明(设计)人: | 李学夔 | 申请(专利权)人: | 中国科学院长春光学精密机械与物理研究所 |
主分类号: | G06T1/60 | 分类号: | G06T1/60 |
代理公司: | 长春科宇专利代理有限责任公司 | 代理人: | 梁爱荣 |
地址: | 130031吉*** | 国省代码: | 吉林;22 |
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摘要: | 本实用新型涉及数据信号处理器的海量静态存储器扩展结构包括DSP1、锁存器2、二或门3、反相门4,一或门5,先将锁存器的使能端置0,使锁存器进入工作状态,然后对IO外部空间执行写操作,所输出的数据通过锁存作为扩展地址,最后进行正常的外部数据空间读写操作即可完成外部大容量存储器的读写。本实用新型用DSP2000系列IO外部空间数据线,能够将DSP本身所具有的数据访问能力从64K的访问能力提高到上百兆,同时只占要一根控制口线,不降低本身工作能力,能够很方便地进行二维地址图象的访问和存储。因此,本实用新型扩展DSP2000的使用领域,能够从事图象处理,数据管理等需要进行大容量数据运算的工作。 | ||
搜索关键词: | 数据 信号 处理器 海量 静态 存储器 扩展 结构 | ||
【主权项】:
1、数据信号处理器的海量静态存储器扩展结构,其特征在于:包括:数据信号处理器(1)、锁存器(2)、二或门(3)、反相门(4)、一或门(5),在数据信号处理器(1)的外部数据端连接锁存器(2);数据信号处理器(1)的选通信号端(IS)和写信号端(WR)分别与一或门(5)输入端连接,一或门(5)输出端与锁存器(2)的一个输入端(CLK)连接,锁存器(2)锁存的外部空间的数据信号端连接在RAM的扩展地址端上,将锁存器(2)的使能端(CLR)与数据信号处理器(1)的控制端口(IO)相连,数据信号处理器(1)的控制端口(IO)又与反相门(4)的输入端相连,选通信号端(IS)又与二或门(3)的一个输入端相连,反相门(4)的输出端与二或门(3)的另一个输入端相连。
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