[发明专利]一种时分－同步码分多址接入的基带芯片无效
| 申请号： | 200410052349.6 | 申请日： | 2004-11-16 |
| 公开（公告）号： | CN1777076A | 公开（公告）日： | 2006-05-24 |
| 发明（设计）人： | 郝劼;李小明 | 申请（专利权）人： | 深圳安凯微电子技术有限公司 |
| 主分类号： | H04J13/00 | 分类号： | H04J13/00;H04J3/02 |
| 代理公司： | 中原信达知识产权代理有限责任公司 | 代理人： | 王永文 |
| 地址： | 518057广东省深圳市高新*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明的一种时分－同步码分多址接入的基带芯片，其包括连接射频芯片的串型接口，至少一数模转换器和至少一模数转换器，分别与发送滤波器和接收滤波器通讯连接；其中，所述基带芯片中还设置有多个硬件加速器，通过硬件实现集成度高的功能模块；并设置有两个数字信号处理器，对应设置有存储装置及协处理器，用于在所述存储装置中储存可变性的功能模块；所述基带芯片还包括加密解密及错误监测功能模块、联合矩阵加速器，以及Viterbi协处理器、Turbo协处理器。本发明产品体积小，功耗和成本都降低了许多，而且功能的刷新和改进更加具有灵活性了。 | ||
| 搜索关键词： | 一种 时分 同步 码分多址 接入 基带 芯片 | ||
【主权项】：
1、一种时分-同步码分多址接入的基带芯片，其包括连接射频芯片的串型接口，至少一数模转换器和至少一模数转换器，分别与发送滤波器和接收滤波器通讯连接；其特征在于，所述基带芯片中还设置有多个硬件加速器，通过硬件实现集成度高的功能模块；并设置有两个数字信号处理器，对应设置有存储装置及协处理器，用于在所述存储装置中储存可变性的功能模块；所述基带芯片还包括加密解密及错误监测功能模块、联合矩阵加速器，以及Viterbi协处理器、Turbo协处理器。
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