[实用新型]一种高速图像数据缓存接口无效

专利信息
申请号: 200320112983.5 申请日: 2003-12-19
公开(公告)号: CN2672737Y 公开(公告)日: 2005-01-19
发明(设计)人: 魏仲慧;何昕;王军 申请(专利权)人: 中国科学院长春光学精密机械与物理研究所
主分类号: G06F3/00 分类号: G06F3/00
代理公司: 长春科宇专利代理有限责任公司 代理人: 刘树清
地址: 130031吉*** 国省代码: 吉林;22
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摘要: 一种高速图像数据缓存接口,属于图像数据处理技术领域中涉及的一种高速图像数据缓存接口,要解决的技术问题是提供一种高速图像数据缓存接口,解决的技术方案是:包括两个锁存器、两个存储器和时序控制逻辑;外部的相机输出数据线,分别送给两个锁存器,时钟信号送给时序控制逻辑后,产生两个锁存脉冲信号分别送给两个锁存器,在该信号上升沿的作用下,将奇数和偶数图像数据分别锁入两个锁存器中;时序控制逻辑输出的奇数写信号送给一个存储器,将一个锁存器输出的图像数据信号写入该存储器中,输出的偶数写信号送给另一个存储器,将另一个锁存器输出的图像数据写入该存储器中,图像数据处理系统发出的读信号,同时将奇数和偶数图像数据信号分别从两个存储器中一起读出。
搜索关键词: 一种 高速 图像 数据 缓存 接口
【主权项】:
1、一种高速图像数据缓存接口,其特征在于本实用新型包括锁存器(1)、存储器(2)、存储器(3),锁存器(4)、时序控制逻辑(5);外部CCD相机输出的数据线分别送给锁存器(1)和锁存器(4)中,时钟信号送给时序控制逻辑(5),时序控制逻辑(5)根据接收到的时钟信号产生两个锁存脉冲信号分别输送给锁存器(1)和锁存器(4,)在该信号上升沿的作用下分别将奇数图像数据信号锁入在锁存器(1)中,将偶数图像数据信号锁入在锁存器(4)中,时序控制逻辑(5)输出的奇数写信号送给存储器(2),在该信号的控制下将锁存器(1)输出的图像数据信号写入存储器(2)中,时序控制逻辑(5)输出的偶数写信号送给存储器(3),在该信号的控制下将锁存器(4)输出的图像数据信号写入存储器(3)中,图像数据处理系统通过本系统发出的读信号同时将奇数图像数据信号从存储器(2)中偶数图像数据信号从存储器(3)中一起读出。
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