[发明专利]平衡负载存储器和操作方法有效
| 申请号： | 03815293.2 | 申请日： | 2003-04-24 |
| 公开（公告）号： | CN1666289A | 公开（公告）日： | 2005-09-07 |
| 发明（设计）人： | 奇特拉·K.·萨布拉曼尼;布拉德利·J.·加尼;约瑟夫·J.·纳哈斯;哈尔伯特·S.·林;托马斯·W.·安德利 | 申请（专利权）人： | 飞思卡尔半导体公司 |
| 主分类号： | G11C7/06 | 分类号： | G11C7/06;G11C7/14;G11C7/18 |
| 代理公司： | 中国国际贸易促进委员会专利商标事务所 | 代理人： | 李德山 |
| 地址： | 美国得*** | 国省代码： | 美国;US |
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| 摘要： | 存储器(10)提供了一种在数据到读放大器(24)所取的理由与基准或各基准到该读放大器所取的理由之间维持阻抗平衡的读出解决方案。该存储器的每个子阵列(14，18)具有相邻的列解码器(20，22)，该相邻列解码器使数据耦合到也与子阵列相邻而且可以看作列解码器的一部分的数据线(37、51、41、63)。使选择的子阵列的数据通过其相邻数据线路由选择到读放大器。作为选择的子阵列的一部分的基准耦合到未选择的子阵列的数据线。因此，对于MRAM型存储器，该基准优选非常接近选择的数据的存储单元，它穿过与数据所取的路由阻抗平衡的、到达读放大器(24)的路由。 | ||
| 搜索关键词： | 平衡 负载 存储器 操作方法 | ||
【主权项】：
1、一种存储器，包括：第一子阵列，包括数据和第一基准；第二子阵列，包括数据和第二基准；第一列解码器，与第一子阵列相邻，具有第一数据线，其中第一数据线选择性地传导第一子阵列输出的数据或者传导第二子阵列输出的第二基准；第二列解码器，与第二子阵列相邻，具有第二数据线，其中第二数据线选择性地传导第二子阵列输出的数据或者传导第一子阵列输出的第一基准；以及第一读放大器，位于第一子阵列与第二子阵列之间，其第一输入端连接到第一数据线，而其第二输入端连接到第二数据线，其输出端用于提供数据。
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