[发明专利]集成电路设计方法无效
| 申请号： | 03811573.5 | 申请日： | 2003-04-25 |
| 公开（公告）号： | CN1656486A | 公开（公告）日： | 2005-08-17 |
| 发明（设计）人： | B·德奥里维拉卡斯特鲁普佩 | 申请（专利权）人： | 皇家飞利浦电子股份有限公司 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50 |
| 代理公司： | 中国专利代理(香港)有限公司 | 代理人： | 傅康;梁永 |
| 地址： | 荷兰艾*** | 国省代码： | 荷兰;NL |
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| 摘要： | 提出了一种设计集成电路(IC)的设计方法和相应的集成电路设计工具。具有由多个互连线(131－139)互连的多个构建模块(121－129)的IC设计由模仿实际IC布局中的构建模块(121－129)和互连(131－139)的位置的二维表示(200)来表示。二维表示允许IC设计者估计互连线(131－139)的长度，这使得IC设计者能够在进入IC设计后端例如IC区域优化之前改变IC设计，从而得到更有效的IC设计方法。 | ||
| 搜索关键词： | 集成电路设计 方法 | ||
【主权项】：
1.一种用于设计集成电路的方法，方法包括：第一步骤，选择多个构建模块用于将希望的算法功能映射到集成电路设计上；第二步骤，在多个构建模块的第一和第二构建模块之间建立连接，以使得能够在第一和第二构建模块之间通信；和显示从执行第一步骤和第二步骤得到的集成电路设计的步骤，其特征在于该方法进一步包括提供有关第一和第二构建模块之间互连长度的互连信息的步骤。
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