[发明专利]软件纠错有效
申请号: | 03807240.8 | 申请日: | 2003-01-27 |
公开(公告)号: | CN1643501A | 公开(公告)日: | 2005-07-20 |
发明(设计)人: | D·维尔克斯 | 申请(专利权)人: | 因芬尼昂技术股份公司 |
主分类号: | G06F11/36 | 分类号: | G06F11/36 |
代理公司: | 中国专利代理(香港)有限公司 | 代理人: | 李亚非;王勇 |
地址: | 德国*** | 国省代码: | 德国;DE |
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摘要: | 一种处理器控制系统允许所存储的程序代码可以被替换。原始代码可以整个存储在第一存储器,例如ROM中,纠错指令存储在第二存储器,例如RAM中,只有存在纠错指令时才访问第二存储器。已接收的存储器地址被分成第一多个最重要的比特和第二多个最不重要的比特。只有第二多个最不重要的比特都等于零,而且有纠错指令存储在RAM中,并且存储的地址等于最重要的比特时,纠错指令才被读出并提供给处理器。这利用了相对较小的附加硬件,而且改进了系统的效率。 | ||
搜索关键词: | 软件 纠错 | ||
【主权项】:
1.一种用于处理器的处理器控制系统,该控制系统包括:装置,用于接收一系列的地址,每个地址包括第一和第二多个地址比特;第一存储器,用于在所述第一存储器的相应于各个所述地址的存储器位置,存储一组用于处理器的指令;第二存储器,用于在所述第二存储器的相应于所述第一多个地址比特的各个组合的存储器位置,存储用于处理器的纠错指令;装置,用于确定何时已收到地址的所述第二多个地址比特都等于零,并在这种情况下,确定第二存储器是否在相应于所述已收到地址的所述第一多个地址比特的存储器位置存储了纠错指令;和装置,用于响应每个已收到的地址提供输出指令,在已收到地址的所述第二多个地址比特都等于零,并且确定第二存储器在相应于所述已收到地址的所述第一多个地址比特的存储位置存储了纠错指令的情况下,该输出指令是从第二存储器读取的纠错指令,否则输出指令从第一存储器中读出。
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