[发明专利]制造半导体器件的方法无效

专利信息
申请号: 00102854.5 申请日: 2000-03-03
公开(公告)号: CN1149655C 公开(公告)日: 2004-05-12
发明(设计)人: 井尾英治 申请(专利权)人: 恩益禧电子股份有限公司
主分类号: H01L21/82 分类号: H01L21/82
代理公司: 中原信达知识产权代理有限责任公司 代理人: 穆德骏;方挺
地址: 日本*** 国省代码: 日本;JP
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摘要: 发明提供一种制造半导体器件的方法,可形成CMOS晶体管和存储单元晶体管而不使可靠性和性能下降。提供如下步骤:用HTO膜覆盖存储单元区,并在CMOS晶体管中形成侧壁的同时暴露CMOS晶体管的扩散区的步骤,淀积钛的步骤,和使扩散区与钛反应,从而在CMOS晶体管源和漏中形成硅化钛的步骤。
搜索关键词: 制造 半导体器件 方法
【主权项】:
1.一种制造半导体器件的方法,包括:形成具有其中形成存储单元晶体管的存储单元区和其中形成CMOS晶体管的CMOS逻辑区的半导体衬底,和在所述存储单元区中形成用于存储单元晶体管的栅极的步骤;用存储单元晶体管使用的所述栅极作为掩模,在所述存储单元区中形成扩散层的第一杂质注入步骤;在所述CMOS逻辑区中形成用于CMOS晶体管的栅极的步骤;用CMOS晶体管的栅极作为掩模,在所述CMOS逻辑区中形成轻掺杂漏的第二杂质注入步骤;形成覆盖所述存储单元区和所述CMOS逻辑区的绝缘膜的绝缘膜形成步骤;形成覆盖所述存储单元区但不包括所述CMOS逻辑区的光刻胶的步骤;利用所述光刻胶作为掩模腐蚀所述绝缘膜、并在用于CMOS晶体管的所述栅极的侧表面中形成侧壁的步骤;用所述侧壁作为掩模,在所述CMOS逻辑区中形成所述CMOS晶体管的扩散层的第三杂质注入步骤;去掉所述掩模层之后,在整个表面上淀积金属的步骤;使所述淀积的金属和所述CMOS晶体管的暴露扩散层反应以形成金属硅化物的步骤。
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