[发明专利]一种适用于姿轨控系统多机容错架构的多机时标仿真方法有效

专利信息
申请号: 202110425173.8 申请日: 2021-04-20
公开(公告)号: CN113438008B 公开(公告)日: 2022-10-28
发明(设计)人: 王晶;张西超;李经松;于海心;党纪红;尚葳蕤;杨俊春;张锦江;李晓锋;董晓刚;李永祺;于海祥;李声涛 申请(专利权)人: 北京控制工程研究所
主分类号: H04B7/185 分类号: H04B7/185;H04B17/391;H04J3/06;G06F9/54
代理公司: 中国航天科技专利中心 11009 代理人: 胡健男
地址: 100080 *** 国省代码: 北京;11
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摘要:
搜索关键词: 一种 适用于 姿轨控 系统 容错 架构 机时 仿真 方法
【权利要求书】:

1.一种适用于姿轨控系统多机容错架构的多机时标仿真方法,其特征在于步骤如下:

步骤(一)将每一个虚拟单机视为进程,每一个虚拟单机为一机,采用相同的多机组成姿轨控系统进行航天器姿轨控,则多机的时标统一就转化成为多机各自进程间的时标统一;多机具有共享内存,利用多机各自进程间可共享内存的特征,使用共享内存模拟临时交换区和串口,进行数据交换和传输,将交换和传输的数据作为多机共享内存的数据;

步骤(二)对多机共享内存的数据进行空间分配,其空间分配遵循独立原则,使每单机对应共享内存中一个独立空间,用于存放对应单机交换和传输的数据,不同独立空间中的数据互不干扰;

步骤(三)在多机并行运行时,多机各自进程间时标统一;将多机共享内存数据交换和传输的过程进行阶段划分,分为数据采集阶段和数据交换阶段,保证多机在数据交换和传输的过程中均为同步状态,即实现任务级的多机时标的统一;

步骤(四)实现任务级的多机时标的统一后,建立同步控制器;采用基于C/S机制的套接字使同步控制器与多机进行通信,多机进程间能够建立起虚拟连接,实现同步控制器与多机间的数据传输;多机各自进程在运行过程中具备同时运行、停止、步进、暂停的调试功能;即实现系统级的多机时标的统一。

2.根据权利要求1所述的一种适用于姿轨控系统多机容错架构的多机时标仿真方法,其特征在于:将每一个虚拟单机视为一个进程,则多机的时标统一就转化成为多机各自进程间的时标统一。

3.根据权利要求1所述的一种适用于姿轨控系统多机容错架构的多机时标仿真方法,其特征在于:使用共享内存模拟临时交换区和串口,进行数据交换和传输,对共享内存中各单机的数据进行空间分配,保证数据独立,相互隔离。

4.根据权利要求1所述的一种适用于姿轨控系统多机容错架构的多机时标仿真方法,其特征在于:利用共享内存的通用读写特征,在共享内存区开辟各单机的独立空间。

5.根据权利要求4所述的一种适用于姿轨控系统多机容错架构的多机时标仿真方法,其特征在于:对共享内存中每个单机的独立空间进行独立区域划分,有几个单机就划分为几块独立区域。

6.根据权利要求5所述的一种适用于姿轨控系统多机容错架构的多机时标仿真方法,其特征在于:各个单机向各自独立空间中的独立区域写入采集的数据。

7.根据权利要求1所述的一种适用于姿轨控系统多机容错架构的多机时标仿真方法,其特征在于:将采集数据向共享内存写入时,如A机给其他单机发送数据的同时,B机也可以向其他单机发送数据,不同的单机操作的区域完全独立,不会有数据冲突。

8.根据权利要求1所述的一种适用于姿轨控系统多机容错架构的多机时标仿真方法,其特征在于:由于各单机采集的数据存放区域独立,数据交换过程中不需要进行时标统一,在数据交换阶段结束后进行时标统一。

9.根据权利要求1所述的一种适用于姿轨控系统多机容错架构的多机时标仿真方法,其特征在于:数据交换阶段结束后,每个单机都拥有所有单机采集的数据。

10.根据权利要求1所述的一种适用于姿轨控系统多机容错架构的多机时标仿真方法,其特征在于:在任务级的时标统一过程中,需要进行数据交换的数据量大,通信频率高,采用共享内存实现通讯,利用内存通信效率高的优势,避免数据交换以及时标统一对单机性能的影响。

11.根据权利要求1所述的一种适用于姿轨控系统多机容错架构的多机时标仿真方法,其特征在于:在系统级的时标统一过程中,设计了同步控制器,与各单机通信,采用基于C/S机制的套接字进行,保证可靠的数据传输。

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